參數(shù)資料
型號(hào)： SC9S12XF512J0MLHR
廠商： FREESCALE SEMICONDUCTOR INC
元件分類(lèi)： 微控制器/微處理器
英文描述： MICROCONTROLLER, QFP64
封裝： LQFP-64
文件頁(yè)數(shù)： 755/1306頁(yè)
文件大?。?/td> 8007K
代理商： SC9S12XF512J0MLHR
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Chapter 13 FlexRay Communication Controller (FLEXRAY)
MC9S12XF - Family Reference Manual, Rev.1.19
Freescale Semiconductor
501
This register provides ve combined interrupt ags and a copy of three individual interrupt ags. The
combined interrupt ags are the result of a binary OR of the values of other interrupt ags regardless of
the state of the interrupt enable bits. The generation scheme for the combined interrupt ags is depicted in
Figure 13-146. The individual interrupt ags WUPIF, FNEBIF, and FNEAIF are copies of corresponding
ags in the Global Interrupt Flag and Enable Register (GIFER) and are provided here to simplify the
application interrupt ag check. To clear the individual interrupt ags, the application must use the Global
NOTE
The meanings of the combined status bits MIF, PRIF, CHIF, RBIF, and
TBIF are different from those mentioned in the Global Interrupt Flag and
Table 13-37. CIFRR Field Descriptions
Field
Description
7
MIF
Module Interrupt Flag — This ag is set if there is at least one interrupt source that has its interrupt ag
asserted.
0 No interrupt source has its interrupt ag asserted
1 At least one interrupt source has its interrupt ag asserted
6
PRIF
Protocol Interrupt Flag — This ag is set if at least one of the individual protocol interrupt ags in the Protocol
0 All individual protocol interrupt ags are equal to 0
1 At least one of the individual protocol interrupt ags is equal to 1
5
CHIF
CHI Interrupt Flag — This ag is set if at least one of the individual CHI error ags in the CHI Error Flag Register
(CHIERFR) is equal to 1.
0 All CHI error ags are equal to 0
1 At least one CHI error ag is equal to 1
4
WUPIF
Wakeup Interrupt Flag — Provides the same value as GIFER[WUPIF]
3
FNEBIF
Receive FIFO channel B Not Empty Interrupt Flag — Provides the same value as GIFER[FNEBI]
2
FNEAIF
Receive FIFO channel A Not Empty Interrupt Flag — Provides the same value as GIFER[FNEAIF]
1
RBIF
Receive Message Buffer Interrupt Flag — This ag is set if for at least one of the individual receive message
buffers (MBCCSRn[MTD] = 0) the interrupt ag MBIF in the corresponding Message Buffer Conguration,
0 None of the individual receive message buffers has the MBIF ag asserted.
1 At least one individual receive message buffers has the MBIF ag asserted.
0
TBIF
Transmit Message Buffer Interrupt Flag — This ag is set if for at least one of the individual single or double
transmit message buffers (MBCCSRn[MTD] = 1) the interrupt ag MBIF in the corresponding Message Buffer
0 None of the individual transmit message buffers has the MBIF ag asserted.
1 At least one individual transmit message buffers has the MBIF ag asserted.
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PDF描述
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參數(shù)描述
SC9S12XF512J0MLMR 制造商:FREESCALE 制造商全稱(chēng):Freescale Semiconductor, Inc 功能描述:S12X Microcontrollers
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