參數(shù)資料
型號： SC9S12XF512J0MLHR
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： MICROCONTROLLER, QFP64
封裝： LQFP-64
文件頁數(shù)： 1228/1306頁
文件大小： 8007K
代理商： SC9S12XF512J0MLHR
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Chapter 20 Pulse Width Modulator with Fault Protection (PMF15B6C) Module
MC9S12XF - Family Reference Manual, Rev.1.19
928
Freescale Semiconductor
20.3.2.30 PMF Enable Control C Register (PMFENCC)
Read anytime and write only if MTG is set.
20.3.2.31 PMF Frequency Control C Register (PMFFQCC)
Read anytime and write only if MTG is set.
Address: $0030
76543210
R
PWMENC
00000
LDOKC
PWMRIEC
W
Reset
0
00000
= Unimplemented or Reserved
Figure 20-36. PMF Enable Control C Register (PMFENCC)
Table 20-32. PMFENCC Field Descriptions
Field
Description
7
PWMENC
PWM Generator C Enable — If MTG is clear, this bit reads zero and cannot be written.
If MTG is set, this bit when set enables the PWM generator C and the PWM4 and PWM5 pins. When PWMENC
is clear, PWM generator C is disabled, and the PWM4 and PWM5 pins are in their inactive states unless the
OUTCTL4 and OUTCTL5 bits are set.
0 PWM generator C and PWM4–5 pins disabled unless the respective OUTCTL bit is set.
1 PWM generator C and PWM4–5 pins enabled.
1
LDOCKC
Load Okay C — If MTG is clear, this bit reads zero and can not be written.
If MTG is set, this bit loads the PRSCC bits, the PMFMODC register and the PWMVAL4–5 registers into a set of
buffers. The buffered prescaler divisor C, PWM counter modulus C value, PWM4–5 pulse widths take effect at
the next PWM reload.
Set LDOKC by reading it when it is logic zero and then writing a logic one to it. LDOKC is automatically cleared
after the new values are loaded, or can be manually cleared before a reload by writing a logic zero to it. Reset
clears LDOKC.
0 Do not load new modulus C, prescaler C, and PWM4–5 values.
1 Load prescaler C, modulus C, and PWM4–5 values.
Note: Do not set PWMENC bit before setting the LDOKC bit and do not clear the LDOKC bit at the same time
as setting the PWMENC bit.
0
PWMRIEC
PWM Reload Interrupt Enable C — If MTG is clear, this bit reads zero and cannot be written.
If MTG is set, this bit enables the PWMRFC ag to generate CPU interrupt requests.
0 PWMRFC CPU interrupt requests disabled
1 PWMRFC CPU interrupt requests enabled
Address: $0031
76543210
R
LDFQC
HALFC
PRSCC
PWMRFC
W
Reset
0
00000
Figure 20-37. PMF Frequency Control C Register (PMFFQCC)
相關PDF資料
PDF描述
S3S12XF512J0VLH MICROCONTROLLER, QFP64
S9S12XF512J0CLMR MICROCONTROLLER, QFP112
SC9S12XF512J0VLMR MICROCONTROLLER, QFP112
MC9S12XHZ512CAL 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP112
MC9S12XHZ512VAL 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP112
相關代理商/技術參數(shù)
參數(shù)描述
SC9S12XF512J0MLMR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:S12X Microcontrollers
SC9S12XF512J0VLHR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:S12X Microcontrollers
SC9S12XF512J0VLMR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:S12X Microcontrollers
SC9S12XS128J1C 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:HCS12 Microcontrollers
SC9S12XS128J1CAA 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:HCS12 Microcontrollers
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