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參數(shù)資料
| 型號： | S1D13A05B00B |
| 元件分類： | 顯示控制器 |
| 英文描述： | 320 X 320 PIXELS CRT OR FLAT PNL GRPH DSPL CTLR, PBGA121 |
| 封裝： | PLASTIC, FBGA-121 |
| 文件頁數(shù)： | 20/190頁 |
| 文件大?。?/td> | 2285K |
| 代理商： | S1D13A05B00B |
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Page 116
Epson Research and Development
Vancouver Design Center
S1D13A05
Hardware Functional Specification
X40A-A-001-02
Issue Date: 02/07/02
bits 9-0
FPFRAME Pulse Start Position Bits [9:0]
These bits specify the start position of the vertical sync signal, in 1 line resolution.
For passive panels, these bits must be set to 00h.
For TFT panels, VDPS is calculated using the following formula.
VPS = REG[3Ch] bits 9-0
Note
bits 16-0
Main Window Display Start Address Bits [16:0]
This register specifies the starting address, in DWORDS, for the LCD image in the display
buffer for the main window.
Note that this is a double-word (32-bit) address. An entry of 00000h into these registers
represents the first double-word of display memory, an entry of 00001h represents the sec-
ond double-word of the display memory, and so on. Calculate the Display Start Address as
follows:
REG[40h] bits 16:0 = image address
÷ 4 (valid only for SwivelView 0°)
Note
For information on setting this register for other SwivelView orientations, see Section
bits 9-0
Main Window Line Address Offset Bits [9:0]
This register specifies the offset, in DWORDS, from the beginning of one display line to
the beginning of the next display line in the main window. Note that this is a 32-bit
address increment. Calculate the Line Address Offset as follows:
REG[44h] bits 9:0 = display width in pixels
÷ (32 ÷ bpp)
Note
A virtual display can be created by programming this register with a value greater than
the formula requires. When a virtual display is created the image width is larger than the
display width and the displayed image becomes a window into the larger virtual image.
Main Window Display Start Address Register
REG[40h]
Default = 00000000h
Read/Write
n/a
bit 16
31
30
29
28
27
26
25
24
23
22
21
20
19
18
17
16
Main Window Display Start Address bits 15-0
15
14
13
12
11
10
9
87654
3210
Main Window Line Address Offset Register
REG[44h]
Default = 00000000h
Read/Write
n/a
31
30
29
28
27
26
25
24
23
22
21
20
19
18
17
16
n/a
Main Window Line Address Offset bits 9-0
15
14
13
12
11
10
9
87654
3210
相關PDF資料 |
PDF描述 |
|---|---|
| S1D13A05F00A100 | 320 X 320 PIXELS CRT OR FLAT PNL GRPH DSPL CTLR, PBGA121 |
| S1R72005F00A300 | UNIVERSAL SERIAL BUS CONTROLLER, PQFP64 |
| S1R72105F00A000 | SCSI BUS CONTROLLER, PQFP100 |
| S1R72803F00A100 | 1 CHANNEL(S), 400M bps, SERIAL COMM CONTROLLER, PQFP100 |
| S1R72C05B08 | UNIVERSAL SERIAL BUS CONTROLLER, PBGA121 |
相關代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| S1D13A05B00B200 | 功能描述:LCD 驅(qū)動器 (QVGA) 320x240 LCD Controller @ 16bpp RoHS:否 制造商:Maxim Integrated 數(shù)位數(shù)量:4.5 片段數(shù)量:30 最大時鐘頻率:19 KHz 工作電源電壓:3 V to 3.6 V 最大工作溫度:+ 85 C 最小工作溫度:- 20 C 封裝 / 箱體:PDIP-40 封裝:Tube |
| S1D13A05F00A100 | 功能描述:顯示驅(qū)動器和控制器 (QVGA) 320x240 LCD Controller @ 16bpp RoHS:否 制造商:Panasonic Electronic Components 工作電源電壓:2.7 V to 5.5 V 最大工作溫度: 安裝風格:SMD/SMT 封裝 / 箱體:QFN-44 封裝:Reel |
| S1D13A05F00A200 | 制造商:Epson Electronics America Inc 功能描述:LCD DRVR 3V/3.3V/5V 80-Pin TQFP |
| S1D-13-F | 功能描述:整流器 200V 1A RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復時間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel |
| S1D13T03F10A100 | 制造商:Epson Electronics America Inc 功能描述:IC EPD CONTROLLER 64TQFP13 制造商:Epson Electronics America Inc 功能描述:EPD Controller Timing control |
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