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參數(shù)資料
| 型號： | RC7100 |
| 文件頁數(shù)： | 696/1328頁 |
| 文件大小： | 9519K |
| 代理商： | RC7100 |
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RC5054A
PRODUCT SPECIFICATION
8
Figure 5. Voltage-Mode Buck
Converter Compensation Design
The modulator transfer function is the small-signal transfer
function of V
OUT
/V
E/A
. This function is dominated by a DC
Gain and the output filter (L
O
and C
O
), with a double pole
break freaquency at F
LC
and a zero at F
ESR
. The DC Gain of
the modulator is simply the input voltage (V
IN
) divided by
the peak-to-peak oscillator voltage
V
OSC
.
Modulator Break Frequency Equations
The compensation network consists of the error amplifier
(internal to the RC5054A) and the impedance networks Z
IN
and Z
FB
. The goal of the compensation network is to provide
a closed loop transfer function with the highest 0dB crossing
frequency (f
0dB
) and adequate phase margin. Phase margin
is the difference between the closed loop phase at f
0dB
and
180 degrees. The equations below relate the compensation
network’s poles, zeros and gain to the components (R1, R2,
R3, C1, C2, and C3) in Figure 5. Use these guidelines for
locating the poles and zeros of the compensation network:
1.
Pick Gain (R2/R1) for desired converter bandwidth
2.
Place 1
ST
Zero Below Filter’s Double Pole (~75% F
LC
)
3.
Place 2
ND
Zero at Filter’s Double Pole
4.
Place 1
ST
Pole at the ESR Zero
5.
Place 2
ND
Pole at Half the Switching Frequency
6.
Check Gain against Error Amplifier’s Open-Loop Gain
7.
Estimate Phase Margin - Repeat if Necessary
Compensation Break Frequency Equations
2
π
R2
C1
Figure 6 shows an asymptotic plot of the DC-DC converter’s
gain vs. frequency. The actual Modulator Gain has a high
gain peak due to the high Q factor of the output filter and is
not shown in Figure 6. Using the above guidelines should
give a Compensation Gain similar to the curve plotted.
The open loop error amplifier gain bounds the compensation
gain. Check the compensation gain at F
P2
with the capabili-
ties of the error amplifier. The Closed Loop Gain is con-
structed on the log-log graph of Figure 6 by adding the
Modulator Gain (in dB) to the Compensation Gain (in dB).
This is equivalent to multiplying the modulator transfer func-
tion to the compensation transfer function and plotting the
gain.
The compensation gain uses external impedance networks
Z
FB
and Z
IN
to provide a stable, high bandwidth (BW) over-
all loop. A stable control loop has a gain crossing with
-20dB/decade slope and a phase margin greater than 45
degrees. Include worst case component variations when
determining phase margin.
Figure 6. Asymptotic Bode Plot of Converter Gain
V
OUT
OSC
REFERENCE
L
O
C
O
ESR
V
IN
D
V
OSC
ERROR
AMP
PWM
DRIVER
(PARASITIC)
Z
FB
+
-
DACOUT
R1
R3
R2
C3
C2
C1
COMP
V
OUT
FB
Z
FB
RC5054
Z
IN
COMPARATOR
DRIVER
DETAILED COMPENSATION COMPONENTS
PHASE
V
E/A
+
-
+
-
Z
IN
F
LC
L
O
2
π
C
O
-----------------1
=
F
ESR
π
ESR
C
O
2
=
F
Z1
---------------1
=
F
P1
2
π
R2
C2
C2
+
C1
-----------------------1
=
F
Z2
+
π
R1
R3
(
)
C3
2
=
F
P2
π
R3
C3
2
=
100
80
60
40
20
0
-20
-40
-60
F
P1
F
Z2
10M
1M
100K
10K
1K
100
10
OPEN LOOP
ERROR AMP GAIN
F
Z1
F
P2
20LOG
(R2/R1)
F
LC
F
ESR
COMPENSATION
GAIN
G
FREQUENCY (Hz)
20LOG
(V
IN
/
V
OSC
)
MODULATOR
GAIN
CLOSED LOOP
GAIN
相關PDF資料 |
PDF描述 |
|---|---|
| RC7352 | |
| RCB001 | |
| RCB002 | |
| RCB004 | |
| RCB005 | |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| RC7101 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Eighteen Distributed-Output Clock Driver |
| RC7102 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述: |
| RC7104 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:CPU System Clock Generator |
| RC7105 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述: |
| RC7106 | 制造商:FAIRCHILD 制造商全稱:Fairchild Semiconductor 功能描述:133MHz Spread Spectrum Clock for Motherboards |
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