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參數(shù)資料
| 型號： | RC7100 |
| 文件頁數(shù)： | 1089/1328頁 |
| 文件大小： | 9519K |
| 代理商： | RC7100 |
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RC7144
PRODUCT SPECIFICATION
6
P
I
2
C Interface Information
The RC7144 features a two-pin, serial data interface that can
be used to configure internal register settings that control
particular device functions. Upon power-up, the RC7144 ini-
tializes with default register settings therefore, the use of this
serial data interface is optional. The serial interface is write-
only (to the clock chip) and is the dedicated function of
device pins SDA and SCL. In motherboard applications,
SDA and SCL are typically driven by two logic outputs of
the chipset. Clock device register changes are normally made
upon system initialization, if any are required. The interface
can also be used during system operation for power manage-
ment functions. Table 1 summarizes the control functions of
the serial data interface.
Table 1. Serial Data Interface Control Functions Summary
Control Function
Clock Output
Disable
Description
Any individual clock output(s) can be
disabled. Disabled outputs are actively
held low.
Provides CPU/PCI frequency selections
other than the 100MHz provided upon
power-on. Frequency is changed in a
smooth and controlled fashion.
Turns spread spectrum on or off.
Common Application
Unused outputs are disabled to reduce EMI
and system power. Examples are clock
outputs to unused PCI slots.
For alternate microprocessors and power
management options. Smooth frequency
transition allows CPU frequency change
under normal system operation.
EMI reduction.
CPU Clock
Frequency Selection
Spread Spectrum
Enabling
Output Tristate
Puts all clock outputs into a high
impedance state.
All clock ouputs toggle in relation to X1
input, internal PLL is bypassed. Refer to
Table 6.
Reserved function for future device
revision or production device testing.
Production PCB testing.
Test Mode
Production PCB testing.
Reserved
No user application. Register bit must be
written as 0.
RC7144 I
2
C Interface Write Sequence Example
MSB
1
1
2
3
4
5
6
7
8
A
1
2
2
3
8
A
1
2
8
A
8
A
1
1
0
1
0
0
1
0
MSB
MSB
MSB
LSB
LSB
LSB
STOP
START
SDA
SCL
SDA
(ACK Signal
From Buffer Chip)
LSB
Slave Address (First Byte)
Signal from Motherboard Clock Chip
Command Code (2nd Byte)
Byte Count (3rd Byte)
Last Data Byte
Note:
Once the clock detects the start condition and its ADDRESS is matched, the clock chip will pull down the SDA at every 8th bit. The 8 bit data
from SDA is latched into the Buffer Chip when the ACK is generated. This ACK signal will continue as long as STOP condition is detected The
COMMAND CODE and BYTE COUNT is not used by the Buffer Chip.
相關PDF資料 |
PDF描述 |
|---|---|
| RC7352 | |
| RCB001 | |
| RCB002 | |
| RCB004 | |
| RCB005 | |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| RC7101 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Eighteen Distributed-Output Clock Driver |
| RC7102 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述: |
| RC7104 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:CPU System Clock Generator |
| RC7105 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述: |
| RC7106 | 制造商:FAIRCHILD 制造商全稱:Fairchild Semiconductor 功能描述:133MHz Spread Spectrum Clock for Motherboards |
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