- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄368232 > PSD813F (意法半導體) Flash In-System-Programmable Microcontroller Peripherals(閃速，在系統(tǒng)可編程微控制器外圍器件，1M位閃速存儲器，256K位EEPROM，16K位SRAM) PDF資料下載
參數(shù)資料
| 型號： | PSD813F |
| 廠商： | 意法半導體 |
| 英文描述： | Flash In-System-Programmable Microcontroller Peripherals(閃速，在系統(tǒng)可編程微控制器外圍器件，1M位閃速存儲器，256K位EEPROM，16K位SRAM) |
| 中文描述： | Flash在系統(tǒng)可編程微控制器外圍設備（閃速，在系統(tǒng)可編程微控制器外圍器件，100萬位閃速存儲器，256K位的EEPROM，16K的位的SRAM） |
| 文件頁數(shù)： | 37/130頁 |
| 文件大小： | 650K |
| 代理商： | PSD813F |
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Preliminary
PSD813F Family
33
The
PSD813F
Functional
Blocks
(cont.)
Flash
Memory
Sectors
FS0-1
Program Space
EEPROM
Sectors
EES0-1
FFFFH
8000H
4000H
0
Flash
Memory
Sectors
FS0-1
Data Space
SRAM
EEPROM
Sectors
EES2-3
FFFFH
8000H
47FFH
4000H
0
Figure 8. 80C31 Memory Map Example
o
Flash Memory Sectors FS0-1 will be mapped from 8000-FFFFH in the Combined
Space Mode (in both Program Space and Data Space). Bits 2 and 4 of the VM Register
are set to 1.
o
EEPROM Sectors EES0-1 will be mapped in the Program Space from 0000H-3FFFH.
EEPROM Sectors EES2-3 will be mapped in the Data Space from 0000H-3FFFH.
Bits 1 and 3 of the VM Register are set to 1.
o
SRAM will be mapped in the Data Space from 4000-47FFH. Bit 0 of the VM Register
is set to 0.
The Abel equations in PSDsoft will be as followed:
FS0
= (Address>= ^h8000) & (Address<=^hBFFF);
FS1
= (Address>= ^hC000) & (Address<=^hFFFF);
EES0 = (Address>= ^h0000) & (Address<=^h1FFF) & !PSEN;
EES1 = (Address>= ^h2000) & (Address<=^h3FFF) & !PSEN;
EES2 = (Address>= ^h0000) & (Address<=^h1FFF) & PSEN;
EES3 = (Address>= ^h2000) & (Address<=^h3FFF) & PSEN;
RS0
= (Address>= ^h4000) & (Address<=^h47FF);
Bit 7
PIO_EN
Bit 6* Bit 5*
Bit 4
Bit 3
Bit 2
Bit 1
RD_EN
Bit 0
PSEN_EN
0 = disable
PIO mode
*
*
1 = RD
can
access
Flash
1 = RD
can
access
EEPROM/
Boot Flash
1 = PSEN
can
access
Flash
1 = PSEN
can
access
EEPROM/
Boot Flash
0 = PSEN
can not
access
SRAM
Table 14. VM Register Contents in the 80C31 Memory Map Example
When the microcontroller reads the VM register, the contents read back are shown in
Table 14. The VM Register content at power up is specified in PSDsoft.
NOTE:
Bits 6-5 are not used.
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