參數(shù)資料
型號： MSC7119VM1200
廠商： 飛思卡爾半導(dǎo)體(中國)有限公司
英文描述： Low-Cost 16-bit DSP with DDR Controller and 10/100 Mbps Ethernet MAC
中文描述： 低成本16位數(shù)字信號處理器與DDR控制器和10/100 Mbps以太網(wǎng)MAC
文件頁數(shù)： 30/56頁
文件大?。?/td> 716K
代理商： MSC7119VM1200
MSC7119 10/100 Mbps Ethernet MAC Data Sheet, Rev. 6
Electrical Characteristics
Freescale Semiconductor
30
2.5.6.2
Transmit Signal Timing
2.5.6.3
Asynchronous Input Signal Timing
Table 22. Transmit Signal Timing
No.
Characteristics
Min
Max
Unit
800
Transmit clock period:
MII: TXCLK
RMII: REFCLK
Transmit clock pulse width high—as a percent of clock period
MII: RXCLK
RMII: REFCLK
Transmit clock pulse width low—as a percent of clock period:
MII: RXCLK
RMII: REFCLK
Transmit clock to TXDn, TX_EN, TX_ER invalid
Transmit clock to TXDn, TX_EN, TX_ER valid
40
20
35
14
7
35
14
7
4
—
—
—
65
—
—
65
—
—
—
14
ns
ns
%
ns
ns
%
ns
ns
ns
ns
801
802
805
806
Figure 11. Ethernet Receive Signal Timing
Table 23. Asynchronous Input Signal Timing
No.
Characteristics
Min
Max
Unit
807
MII: CRS and COL minimum pulse width (1.5
×
TXCLK period)
RMII: CRS_DV minimum pulse width (1.5 x REFCLK period)
60
30
—
—
ns
ns
Figure 12. Asynchronous Input Signal Timing
Valid
Transmit
clock
TX_EN
TX_ER
TXDn
805
806
800
801
802
CRS
COL
807
CRS_DV
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PDF描述
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參數(shù)描述
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