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參數(shù)資料
| 型號(hào)： | MPC9855 |
| 廠商： | Motorola, Inc. |
| 英文描述： | Clock Generator for PowerQUICC and PowerPC Microprocessors |
| 中文描述： | 微處理器時(shí)鐘發(fā)生器為PowerQUICC和PowerPC |
| 文件頁(yè)數(shù)： | 3/12頁(yè) |
| 文件大?。?/td> | 267K |
| 代理商： | MPC9855 |
Timing Solutions
Freescale Semiconductor
3
MPC9855
Table 1. Pin Configurations
Pin
I/O
Type
Function
Supply
Active/State
CLK
Input
LVCMOS PLL reference clock input (pull-down)
V
DD
—
PCLK,
PCLK
Input
LVPECL
PLL reference clock input
(PCLK — pull-down,
PCLK
— pull-up and pull-down)
V
DD
—
QA0, QA1,
QA2, QA3
QB0, QB1,
QB2, QB3
Output
LVCMOS Clock Outputs
V
DDOA
—
REF_OUT0
REF_OUT1
Output
LVCMOS Reference Output (25 MHz or 33 MHz)
V
DD
—
XTAL_IN
Input
LVCMOS Crystal Oscillator Input Pin
V
DD
—
XTAL_OUT
Output
LVCMOS Crystal Oscillator Output Pin
V
DD
—
CLK_SEL
Input
LVCMOS Select between CLK and PCLK input (pull-down)
V
DD
High
XTAL_SEL
Input
LVCMOS Select between External Input and Crystal Oscillator Input
(pull-down)
V
DD
High
REF_33 MHz
Input
LVCMOS Selects 33MHz input (pull-down)
V
DD
High
REF_OUT1_E
Input
LVCMOS Enables REF_OUT! output (pull-down)
V
DD
High
MR
Input
LVCMOS Master Reset (pull-up)
V
DD
Low
PLL_BYPASS
Input
LVCMOS Select PLL or static test mode (pull-up)
V
DD
High
CLK_A[0:5]
(1)
1. Power PC bit ordering (bit 0 = msb, bit 5 = lsb).
Input
LVCMOS Configures Bank A clock output frequency (pull-up)
V
DD
—
CLK_
B
[0:5]
1
Input
LVCMOS Configures Bank B clock output frequency (pull-up)
V
DD
—
V
DD
—
—
3.3 V Supply
—
—
V
DDA
—
—
Analog Supply
—
—
V
DDOA
—
—
Output Supply — Bank A
—
—
V
DDOB
—
—
Output Supply — Bank B
—
—
GND
—
—
Ground
—
—
Table 2. Function Table
Control
Default
0
1
CLK_SEL
0
CLK
PCLK
XTAL_SEL
0
CLKx
XTAL
PLL_BYPASS
0
Normal
Bypass
REF_OUT1_E
0
Disables REF_OUT1
Enables REF_OUT1
REF_33 MHz
0
Selects 25 MHz Reference
Selects 33 MHz Reference
MR
1
Reset
Normal
CLK_A and CLK_B control output frequencies. Refer to
Table 3
for specific device configuration
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MPC992 | Low Voltage PLL Clock Driver(低壓PLL時(shí)鐘驅(qū)動(dòng)器) |
| MPC993 | Dynamic Switch PLL Clock Driver(動(dòng)態(tài)開關(guān)PLL時(shí)鐘驅(qū)動(dòng)器) |
| MPC9990 | Low Voltage PLL Clock Driver(低壓PLL時(shí)鐘驅(qū)動(dòng)器) |
| MPF102 | JFET VHF Amplifier |
| MPF102 | JFET VHF Amplifier |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MPC9855VM | 功能描述:時(shí)鐘發(fā)生器及支持產(chǎn)品 RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56 |
| MPC9855VMR2 | 功能描述:時(shí)鐘發(fā)生器及支持產(chǎn)品 RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56 |
| MPC9865VM | 功能描述:時(shí)鐘發(fā)生器及支持產(chǎn)品 RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56 |
| MPC9865VMR2 | 功能描述:時(shí)鐘發(fā)生器及支持產(chǎn)品 RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56 |
| MPC9893 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Low Voltage PLL Intelligent Dynamic Clock (IDCS) Switch |
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