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參數(shù)資料
| 型號： | MD80C32-20/883:D |
| 廠商： | ATMEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, 20 MHz, MICROCONTROLLER, CDIP40 |
| 封裝： | CERAMIC, DIP-40 |
| 文件頁數(shù)： | 135/395頁 |
| 文件大?。?/td> | 9022K |
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22
ATmega64A [DATASHEET]
8160D–AVR–02/2013
8.5.5
Pull-up and Bus Keeper
The pull-ups on the AD7:0 ports may be activated if the corresponding Port Register is written to one. To reduce
power consumption in sleep mode, it is recommended to disable the pull-ups by writing the Port Register to zero
before entering sleep.
The XMEM interface also provides a Bus Keeper on the AD7:0 lines. The Bus Keeper can be disabled and enabled
in software as described in “XMCRB – External Memory Control Register B” on page 28. When enabled, the Bus
Keeper will ensure a defined logic level (zero or one) on the AD7:0 bus when these lines would otherwise be tri-
stated by the XMEM interface.
8.5.6
Timing
External memory devices have different timing requirements. To meet these requirements, the ATmega64A XMEM
interface provides four different wait states as shown in Table 8-3. It is important to consider the timing specifica-
tion of the external memory device before selecting the wait-state. The most important parameters are the access
time for the external memory compared to the set-up requirement of the ATmega64A. The access time for the
external memory is defined to be the time from receiving the chip select/address until the data of this address actu-
ally is driven on the bus. The access time cannot exceed the time from the ALE pulse is asserted low until data
must be stable during a read sequence (t
ent wait states are set up in software. As an additional feature, it is possible to divide the external memory space in
two sectors with individual wait-state settings. This makes it possible to connect two different memory devices with
different timing requirements to the same XMEM interface. For XMEM interface timing details, please refer to Fig-
Note that the XMEM interface is asynchronous and that the waveforms in the following figures are related to the
internal system clock. The skew between the internal and external clock (XTAL1) is not guaranteed (varies
between devices, temperature, and supply voltage). Consequently the XMEM interface is not suited for synchro-
nous operation.
Figure 8-6.
External Data Memory Cycles without Wait State(1)
(SRWn1 = 0 and SRWn0 =0)
Note:
1. SRWn1 = SRW11 (upper sector) or SRW01 (lower sector), SRWn0 = SRW10 (upper sector) or SRW00 (lower sec-
tor).
The ALE pulse in period T4 is only present if the next instruction accesses the RAM (internal or external).
ALE
T1
T2
T3
Wr
ite
Read
WR
T4
A15:8
Address
Prev. addr.
DA7:0
Address
Data
Prev. data
XX
RD
DA7:0 (XMBK = 0)
Data
Prev. data
Address
Data
Prev. data
Address
DA7:0 (XMBK = 1)
System Clock (CLKCPU)
XXXXX
XXXXXXXX
相關PDF資料 |
PDF描述 |
|---|---|
| MD80C52TXXX-25SCD | 8-BIT, MROM, 25 MHz, MICROCONTROLLER, CDIP40 |
| MD80C52CXXX-12SHXXX | 8-BIT, MROM, 12 MHz, MICROCONTROLLER, CDIP40 |
| MR80C52XXX-16P883 | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CQCC44 |
| MF280C51-12R | 8-BIT, MROM, 12 MHz, MICROCONTROLLER, PQFP44 |
| M43C505F | 4-BIT, MROM, 2 MHz, MICROCONTROLLER |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MD80C32-25 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
| MD80C32-30 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
| MD80C51 | 制造商:TEMIC 制造商全稱:TEMIC Semiconductors 功能描述:CMOS 0 to 44 MHz Single-Chip 8 Bit Microcontroller |
| MD80C51BH | 制造商:ROCHESTER 制造商全稱:ROCHESTER 功能描述:CMOS SINGLE - CHIP 8-BIT MICROCOMPUTER 64K program Memory Space |
| MD80C51FB | 制造商:Rochester Electronics LLC 功能描述: |
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