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參數(shù)資料
| 型號(hào)： | MCIMX535DVV1B |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | SPECIALTY MICROPROCESSOR CIRCUIT, PBGA529 |
| 封裝： | 19 X 19 MM, 0.80, MM PITCH, ROHS COMPLIANT, PLASTIC, TEPBGA-529 |
| 文件頁數(shù)： | 126/204頁 |
| 文件大?。?/td> | 5605K |
| 代理商： | MCIMX535DVV1B |
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i.MX53xD Applications Processors for Consumer Products, Rev. 3
28
Freescale Semiconductor
Electrical Characteristics
4.2.2
Power-Down Sequence
Power-down sequence should follow one of the following two options:
Option 1: Switch all supplies down simultaneously with further free discharge. A deviation of few
microseconds of actual power-down of the different power rails is acceptable.
Option 2: Switch down supplies, in any order, keeping the following rules:
NVCC_CKIH must be powered down at the same time or after the UHVIO IO cell supplies (for
microseconds of actual power-down of the different power rails is acceptable.
VDD_REG must be powered down at the same time or after NVCC_EMI_DRAM supply. A
deviation of few microseconds of actual power-down of the different power rails is acceptable.
If all of the following conditions are met:
—1. VDD_REG is powered down to 0V (Not Hi-Z)
—2. VDD_DIG_PLL and VDD_ANA_PLL are provided externally,
—3. VDD_REG is powered down before VDD_DIG_PLL and VDD_ANA_PLL
Then the following rule should be kept: VDD_REG output impedance must be higher than 1 k
Ω,
when inactive.
4.2.3
Power Supplies Usage
All IO pins should not be externally driven while the IO power supply for the pin (NVCC_xxx) is
off. This can cause internal latch-up and malfunctions due to reverse current flows. For information
about IO power supply of each pin refer to “Power Rail” columns in pin list tables of Section 6,
If not using SATA interface and the embedded thermal sensor, the VP and VPH should be
grounded. In particular, keeping VPH turned OFF while the VP is powered ON is not
recommended and might lead to excessive power consumption.
When internal clock source is used for SATA temperature monitor the USB_PHY supplies and
PLL need to be active because they are providing the clock.
If not using TVE the module, the TVDAC_DHVDD and TVDAC_AHVDDRGB can remain
floating. If only the GPIO pads in TVDAC_AHVDDRGB domain are in use, the supplies can be
set to GPIO pad voltage range (1.65 V to 3.1 V).
4.3
I/O DC Parameters
This section includes the DC parameters of the following I/O types:
General Purpose I/O (GPIO)
Double Data Rate 3 I/O (DDR3) for DDR2/LVDDR2, LPDDR2 and DDR3 modes
Low Voltage I/O (LVIO)
Ultra High Voltage I/O (UHVIO)
LVDS I/O
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MCL908QY1DWE | 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDSO16 |
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| MCL908QT4CPE | 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDIP8 |
| MCL908QY2CDTE | 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDSO16 |
| MCL908QY1CDT | 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDSO16 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| MCIMX535DVV1C | 制造商:Freescale Semiconductor 功能描述:IMX53 REV 2.1 COMM |
| MCIMX535DVV1C2 | 制造商:Freescale Semiconductor 功能描述:MCIMX535DVV1C2 - Bulk |
| MCIMX535DVV1CR2 | 功能描述:處理器 - 專門應(yīng)用 iMX53 Rev 2.1 Comm RoHS:否 制造商:Freescale Semiconductor 類型:Multimedia Applications 核心:ARM Cortex A9 處理器系列:i.MX6 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:1 GHz 指令/數(shù)據(jù)緩存: 數(shù)據(jù) RAM 大小:128 KB 數(shù)據(jù) ROM 大小: 工作電源電壓: 最大工作溫度:+ 95 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:MAPBGA-432 |
| MCIMX535DVV2C | 功能描述:處理器 - 專門應(yīng)用 iMX53 Rev 2.1 Comm RoHS:否 制造商:Freescale Semiconductor 類型:Multimedia Applications 核心:ARM Cortex A9 處理器系列:i.MX6 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:1 GHz 指令/數(shù)據(jù)緩存: 數(shù)據(jù) RAM 大小:128 KB 數(shù)據(jù) ROM 大小: 工作電源電壓: 最大工作溫度:+ 95 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:MAPBGA-432 |
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