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參數(shù)資料
| 型號(hào)： | MC68HC05L16CFU |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | PLASTIC, QFP-80 |
| 文件頁數(shù)： | 134/146頁 |
| 文件大?。?/td> | 852K |
| 代理商： | MC68HC05L16CFU |
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Timer System
MC68HC05L16 MC68HC705L16 Data Sheet, Rev. 4.1
88
Freescale Semiconductor
9.3.4 Timer Counter Register 2
TCNT2 is incremented by the falling edge of the timer clock, which is synchronized and has the same
timing as the falling edge of PH2.
The TCNT2 register is compared with the OC2 buffer register and initialized to $01 if it matches. It is also
initialized to $01 on reset and any CPU write to this register.
The CPU read of this counter should be done while PH2 is high. Data may be latched by the local or main
data bus while PH2 is low.
9.3.5 Timebase Control Register 1
T2R1/T2R0 — Prescale Rate Select Bits for Timer 2
The T2R1 and T2R0 bits select prescale rate of CLK2 for timer 2 and timer input 2. These bits are
cleared on reset.
Address:
$001F
BIt 7
654321
Bit 0
Read:
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Write:
Reset:
00000001
Address:
$0010
BIt 7
654321
Bit 0
Read:
TBCLK
0
LCLK
0
T2R1
T2R0
Write:
Reset:
00000000
Figure 9-12. Timebase Control Register 1 (TBCR1)
Table 9-2. Timebase Prescale Rate Selection
T2R1
T2R0
System Clock
Divided by
00
1
01
4
10
32
11
256
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| MC68HC711D3FNR2 | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PQCC44 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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