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參數(shù)資料
| 型號： | MC68EZ328PU16V |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | MICROPROCESSOR, PQFP100 |
| 封裝： | 14 X 14 MM, 0.50 MM PITCH, PLASTIC, TQFP-100 |
| 文件頁數(shù)： | 193/246頁 |
| 文件大?。?/td> | 2507K |
| 代理商： | MC68EZ328PU16V |
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Chip-Select Logic
4-4
MC68EZ328 USERS MANUAL
MOTOROLA
be nonvalid, so they will not assert until they are programmed and the EN bit is set in the
chip-select registers.
4.1.3 Overlapping Chip-Select Registers
You should not program the group address and chip-select registers to overlap. If you do,
the chip-select signals will overlap. Unused chip-selects must be disabled. Map them to an
unused space, if possible.
When the CPU tries to write to a read-only location that you have programmed, the
chip-select and DTACK signals will not be generated internally. BERR will be asserted
internally if the bus error time-out function is enabled.
4.2 PROGRAMMING MODEL
The chip-select module contains registers that you can use to control external devices, such
as memory. Chip-selects do not operate until the register in a particular group of devices is
initialized and the EN bit is set in the corresponding chip-select register. The only exception
is the CSA0 signal, which is the boot device chip-select.
4.2.1 Chip-Select Group Base Address Registers
There are four 16-bit chip-select group base address A-D (CSGBA-CSGBD) registers in the
chip-select module (one for each chip-select group). These registers define the address at
which the chip-select starts. For example, the CSA0 signal can start at 0x000000 if you
program the CSGBA register and CSA1 returns the selected memory size apart from CSA0.
Note: If the group address and chip-select registers are programmed to overlap, the
chip-select signals will overlap too. Unused chip-selects must be programmed to
0 wait-states and 16 bits wide. Map them to dummy space if necessary. When
you are configuring the chip-select signals, the core can be set to write to a
read-only location. This prevents the chip-select and DTACK signals from not
being asserted, but the internal BERR signal to be asserted, if a bus error timer
is enabled.
Note:
The chip-select logic does not allow an address match during interrupt
acknowledge cycles.
CSGBA-CSGBD
BIT
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
FIELD
GBA28
GBA27
GBA26
GBA25
GBA24
GBA23
GBA22
GBA21
GBA20
GBA19
GBA18
GBA17
GBA16
GBA15
GBA14
RESET
0x0000
ADDR
0x(FF)FFF100, 102, 104, 106
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