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參數(shù)資料
| 型號： | MC68EZ328PU16V |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | MICROPROCESSOR, PQFP100 |
| 封裝： | 14 X 14 MM, 0.50 MM PITCH, PLASTIC, TQFP-100 |
| 文件頁數(shù)： | 183/246頁 |
| 文件大?。?/td> | 2507K |
| 代理商： | MC68EZ328PU16V |
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Signal Descriptions
MOTOROLA
MC68EZ328 USERS MANUAL
2-9
SPMCLK/PE2SPI Master Clock and Port E Bit 2. This pin is the clock output when
the serial peripheral interface master is enabled. In polarity = 0 mode, this signal is low
while the serial peripheral interface master is idle. In polarity = 1 mode, this signal is
high during idle. This pin defaults to a general-purpose PE2 input signal.
2.13 CHIP-SELECT SIGNALS
CSA0Chip-Select A Bit 0. CSA0 is a default chip-select signal after reset. It is set to
six wait-states and decodes all address ranges, except internal register address space
and emulator space (0xFFFC0000-0xFFFDFFFF). It can be reprogrammed during the
boot sequence to another address range or different wait-states. The default data bus
width for CSA0 is determined by the state of the BUSW signal.
CSA1/PF7, CSB[1:0]/PB[1:0], CSC[1:0]/PB[3:2], CSD[1:0]/PB[5:4]Chip-Select A,
B, C, and D Bits 0 and 1, Port F Bit 7, Port B Bits 5-0. These pins comprise the
remainder of the Group A, B, C, and D chip-selects and are individually programmable.
Pins that are not needed as chip-selects can be programmed as general-purpose I/Os.
In addition, CSC[1:0] and CSD[1:0] are designed to support DRAM as CAS and RAS
signals. These pins default to a general-purpose input signal.
2.14 IN-CIRCUIT EMULATION SIGNALS
HIZ/P/D/PG3High Impedance, Program/Data, and Port G Bit 3. During system reset,
a logic low of this input signal will put the MC68EZ328 into Hi-Z mode, in which all
MC68EZ328 pins are three-stated after reset release. For normal operation, this pin
must be pulled high during system reset or left unconnected. This pin defaults to the
P/D function, but can be programmed as a general-purpose I/O. P/D is a status signal
that shows whether the current bus cycle is in program space or in data space during
emulation mode.
EMUIRQ/PG2Emulator Interrupt Request and Port G Bit 2. During system reset, a
logic low of this input signal will put the MC68EZ328 into emulation mode, which is
described in . For normal operation, this pin must be pulled high during system reset
or left unconnected. After system reset this pin defaults to an EMUIRQ function in
normal or emulation mode. EMUIRQ is an active low, level 7 interrupt input signal.
EMUBRK/PG5Emulator Breakpoint and Port G Bit 5. During system reset, a logic low
of this input signal will put the MC68EZ328 into bootstrap mode, which is described in
. For normal operation, this pin must be pulled high during system reset or left
unconnected. After system reset, this pin defaults to the EMUBRK function, which is an
I/O signal used in emulation mode for breakpoint control.
EMUCS/PG4Emulator Chip-Select and Port G Bit 4. EMUCS is an 8-bit data bus
width chip-select signal that selects the dedicated memory space from 0xFFFC0000 to
0xFFFDFFFF. It cannot be used to select 16-bit data bus memory devices. EMUCS is
not only activated in emulation mode, but in normal and bootstrap modes as well. See
for more information about EMUCS operation. This pin defaults to an EMUCS signal.
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