參數(shù)資料
型號： MC56F8147VVFE
廠商： Freescale Semiconductor
文件頁數(shù)： 56/172頁
文件大小： 0K
描述： IC DGTL SIGNAL CTLR 160-MAPBGA
標(biāo)準(zhǔn)包裝： 126
系列： 56F8xxx
核心處理器： 56800E
芯體尺寸： 16-位
速度： 40MHz
連通性： EBI/EMI，SCI，SPI
外圍設(shè)備： POR，PWM，WDT
輸入/輸出數(shù)： 76
程序存儲器容量： 128KB（64K x 16）
程序存儲器類型： 閃存
RAM 容量： 4K x 16
電壓 - 電源 (Vcc/Vdd)： 2.25 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 16x12b
振蕩器型： 外部
工作溫度： -40°C ~ 105°C
封裝/外殼： 160-BGA
包裝： 托盤
Controller Area Network (CAN) Timing
56F8347 Technical Data, Rev.11
Freescale Semiconductor
149
Preliminary
10.14 Controller Area Network (CAN) Timing
Note: CAN is not available in the 56F8147 device.
Figure 10-18 Bus Wake Up Detection
10.15 JTAG Timing
Table 10-22 CAN Timing1
1. Parameters listed are guaranteed by design
Characteristic
Symbol
Min
Max
Unit
See Figure
Baud Rate
BRCAN
—
1
Mbps
—
Bus Wake Up detection
T WAKEUP
5
—
μs
Table 10-23 JTAG Timing
Characteristic
Symbol
Min
Max
Unit
See Figure
TCK frequency of operation using EOnCE 1
1. TCK frequency of operation must be less than 1/8 the processor rate.
fOP
DC
SYS_CLK/8
MHz
TCK frequency of operation not using EOnCE1
fOP
DC
SYS_CLK/4
MHz
TCK clock pulse width
tPW
50
—
ns
TMS, TDI data set-up time
tDS
5—
ns
TMS, TDI data hold time
tDH
5—
ns
TCK low to TDO data valid
tDV
—30
ns
TCK low to TDO tri-state
tTS
—30
ns
TRST assertion time
tTRST
2T2
2. T = processor clock period (nominally 1/60MHz)
—ns
T WAKEUP
CAN_RX
CAN receive
data pin
(Input)
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PDF描述
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參數(shù)描述
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