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參數(shù)資料
| 型號： | MC145152DW2R2 |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 7/24頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC PAR-IN PLL FREQ SYNTH 28-SOIC |
| 標準包裝： | 1,000 |
| 類型： | PLL 時鐘/頻率合成器 |
| PLL： | 是 |
| 輸入： | 時鐘 |
| 輸出： | CMOS |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:1 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 25MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 3 V ~ 9 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 28-SOIC（0.295"，7.50mm 寬） |
| 供應商設(shè)備封裝： | 28-SOIC W |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | MC145152DW2TR |
MC145151-2 and MC145152-2 Electrical Characteristics
MC145151-2 and MC145152-2 Technical Data, Rev. 5
Freescale Semiconductor
15
Figure 9. Switching Waveforms
Table 4. AC Electrical Characteristics
(CL = 50 pF, Input tr = tf = 10 ns)
Symbol
Parameter
VDD
V
Guaranteed Limit
25
°C
Guaranteed Limit
-40 to 85
°C
Unit
tPLH, tPHL Maximum Propagation Delay, fin to MC
(Figure 9a and Figure 9d)
3
5
9
110
60
35
120
70
40
ns
tPHL
Maximum Propagation Delay, ENB to SW1, SW2
(Figure 9a and Figure 9e)
3
5
9
160
80
50
180
95
60
ns
tw
Output Pulse Width,
φ
R, φV, and LD with fR in Phase with fV
(Figure 9b and Figure 9d)
3
5
9
25 to 200
20 to 100
10 to 70
25 to 260
20 to 125
10 to 80
ns
tTLH
Maximum Output Transition Time, MC
(Figure 9c and Figure 9d)
3
5
9
115
60
40
115
75
60
ns
tTHL
Maximum Output Transition Time, MC
(Figure 9c and Figure 9d)
3
5
9
60
34
30
70
45
38
ns
tTLH, tTHL Maximum Output Transition Time, LD
(Figure 9c and Figure 9d)
3
5
9
180
90
70
200
120
90
ns
tTLH, tTHL Maximum Output Transition Time, Other Outputs
(Figure 9c and Figure 9d)
3
5
9
160
80
60
175
100
65
ns
TEST
POINT
DEVICE
UNDER
TEST
CL*
* Includes all probe and fixture capacitance.
TEST
POINT
DEVICE
UNDER
TEST
CL*
* Includes all probe and fixture capacitance.
VDD
15 k
t
90%
10%
tTHL
ANY
OUTPUT
Figure 9a. Maximum Propagation Delay
Figure 9b. Output Pulse Width
50%
OUTPUT
50%
INPUT
tPLH
- VSS
VDD
tPHL
50%
φ
R, φV, LD*
*fR in phase with fV.
tw
OUTPUT
Figure 9c. Maximum Output Transition Time
Figure 9d. Test Circuit
Figure 9e. Test Circuit
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