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參數(shù)資料
| 型號： | MC145152DW2R2 |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 3/24頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC PAR-IN PLL FREQ SYNTH 28-SOIC |
| 標(biāo)準(zhǔn)包裝： | 1,000 |
| 類型： | PLL 時鐘/頻率合成器 |
| PLL： | 是 |
| 輸入： | 時鐘 |
| 輸出： | CMOS |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:1 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 25MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 3 V ~ 9 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 28-SOIC（0.295"，7.50mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 28-SOIC W |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | MC145152DW2TR |
MC145152-2 Parallel-Input (Interfaces with Dual-Modulus Prescalers)
MC145151-2 and MC145152-2 Technical Data, Rev. 5
Freescale Semiconductor
11
Figure 8. 666-Channel Computer-Controlled, Mobile Radiotelephone Synthesizer
for 800 MHz Cellular Radio Systems
NOTES:
1. Receiver 1st I.F. = 45 MHz, low side injection; Receiver 2nd I.F. = 11.7 MHz, low side injection.
2. Duplex operation with 45 MHz receiver/transmit separation.
3. fR = 7.5 kHz; ÷ R = 2048.
4. Ntotal = N 64 + A = 27501 to 28166; N = 429 to 440; A = 0 to 63.
5. High frequency prescalers may be used for higher frequency VCO and fref
implementations.
6. The
φ
R and φV outputs are fed to an external combiner/loop filter. See the Phase-Locked Loop - Low-Pass Filter Design page for
additional information. The
φ
R and φV outputs swing rail-to-rail. Therefore, the user should be careful not to exceed the common mode
input range of the op amp used in the combiner/loop filter.
LOCK DETECT SIGNAL
R1
+
RECEIVER FIRST L.O.
825.030
→ 844.980 MHz
(30 kHz STEPS)
÷ 64/65 PRESCALER
NOTE 5
MC145152-2
MC
LD
A0
A5
N9
OSCin
VDD
VSS
OSCout
RA2
RA1
φ
R
φ
V
fin
-
VCO
RA0
N0
+ V
R1
R2
C
R2
C
“1"
CHANNEL PROGRAMMING
REF. OSC.
15.360 MHz
(ON-CHIP OSC.
OPTIONAL)
X2
X4
NOTE 5
X4
NOTE 5
TRANSMITTER
MODULATION
TRANSMITTER SIGNAL
825.030
→ 844.980 MHz
(30 kHz STEPS)
RECEIVER 2ND L.O.
30.720 MHz
NOTE 6
NO CONNECTS
相關(guān)PDF資料 |
PDF描述 |
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