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參數(shù)資料
| 型號(hào)： | MB90246APFV |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, 16 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | PLASTIC, LQFP-100 |
| 文件頁(yè)數(shù)： | 66/100頁(yè) |
| 文件大?。?/td> | 1959K |
| 代理商： | MB90246APFV |
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68
MB90246A Series
RD/WRH/WRL signal standards
(AVCC = VCC = 4.5 V to 5.5 V, AVSS = VSS = 0.0 V, TA = –30
°C to +70°C)
N: Stands for the number of wait cycles. With no wait, N is set at “0”. (The number of wait cycles depends on an
automatic wait and external RDY.)
m: Stands for the number of RDY wait cycles. With no wait, m is set at “0”.
*1: Use the automatic ready function when the setup time is not sufficient.
*2: If the pulse width has exceeded the maximum value, the wait period may be extended beyond the specified
number of cycles by one cycle.
*3: For tCYC (cycle time (machine cycle)), see paragraph (4), “Clock output timing.”
Parameter
Symbol
Pin name
Condition
Value
Unit Remarks
Min.
Max.
RD/WRH/WRL
↓ →
RDY
↓ time
tRYHS
RD/WRH/
WRL,
RDY
—0
N
×1 tCYC*3
+ 15*1
ns
RDY pulse width
tRYPW
RDY
VCC = 5.0 V
±10% 1/2 tCYC*
3
+ 20
(m + 1)
× 1
tCYC*2,*3
ns
RDY
↑ → RD ↑
tRHDV
RD/WRH/
WRL,
RDY
—
1 tCYC*3
– 15
2 tCYC*3
– 25
ns
RD/WRH/WRL
RDY
(wait not inserted)
RDY
(wait inserted)
A00 to A23
tRHDV
0.8 V
tRYHS
2.2 V
0.8 V
2.4 V
Ready input timing (RD/WRH/WRL signal standards)
2.2 V
tRYPW
2.2 V
0.8 V
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