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參數(shù)資料
| 型號(hào)： | MB90246APFV |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, 16 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | PLASTIC, LQFP-100 |
| 文件頁(yè)數(shù)： | 65/100頁(yè) |
| 文件大?。?/td> | 1959K |
| 代理商： | MB90246APFV |
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67
MB90246A Series
(5) Ready Input Timing
CLK signal standards
(AVCC = VCC = 4.5 V to 5.5 V, AVSS = VSS = 0.0 V, TA = –30
°C to +70°C)
N: Stands for the number of wait cycles. With no wait, N is set at “0”. (The number of wait cycles depends on an
automatic wait and external RDY.)
* : For tCYC (cycle time (machine cycle)), see paragraph (4), “Clock output timing.”
Note: Use the automatic ready function when the setup time for the rising edge of the RDY signal is not sufficient.
Parameter
Symbol
Pin name
Condition
Value
Unit Remarks
Min.
Max.
RD/WRH/WRL
↓ →
RDY
↓ time
tRYHS
RD/WRH/
WRL,
RDY
0
N
×1 tCYC*
+ 15
ns
RDY setup time
(in diallocating)
tRHDV
RDY
VCC = 5.0 V
±10%
30
—
ns
RDY hold time
tRYHH
RDY
—
0
—
ns
CLK
RD/WRH/WRL
RDY
(wait not inserted)
RDY
(wait inserted)
A00 to A23
tRHDV
0.8 V
tRYHH
2.2 V
0.8 V
2.2 V
Ready input timing (CLK signal standards)
tRYH
tRYHH
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