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參數(shù)資料
| 型號： | MB86R01PB-GSE1 |
| 廠商： | Fujitsu Semiconductor America Inc |
| 文件頁數(shù)： | 78/89頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC SOC GRAPHIC CONTRLR 484BGA |
| 特色產(chǎn)品： | Graphics Display Controllers (GDC) |
| 標(biāo)準(zhǔn)包裝： | 40 |
| 系列： | 玉 |
| 應(yīng)用： | 圖形控制器 |
| 核心處理器： | ARM9 |
| 程序存儲器類型： | 外部程序存儲器 |
| 控制器系列： | 玉 |
| RAM 容量： | 64K x 8 |
| 接口： | ADC，ATA，CAN，EBI/EMI，I²C，I²S，媒體 LB，PWM，SD 卡，UART/USART，USB |
| 輸入/輸出數(shù)： | 24 |
| 電源電壓： | 1.1 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 484-BGA |
| 包裝： | 托盤 |
| 供應(yīng)商設(shè)備封裝： | 484-BGA（23x23） |
| 其它名稱： | 865-1110 |
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2
FUJITSU MICROELECTRONICS
PROPRIETARY AND CONFIDENTIAL
MB86R01 DATA SHEET
I2S is addable up to 3ch
The number of UART channel is extensible up to 6ch
The data width in the external bus interface is extensible to 32 bit
3.
Block diagram
Figure 3-1 shows block diagram of MB86R01.
CRG
M1-0
M1-1
S1-00
M1-2
S1-01
Master No.
Slave No.
DMAC
8ch
S1-04
RBC
GPIO
24ch
EXTIRC
4ch
UART
×4
32bit
Timer
2ch
I-TCM
16KB
ETM9CSSingle
S1-12
S1-05
S1-02
USB2.0
Host
M1-4
SRAM
32KB
S1-10
MediaLB
IDE66
S1-08
CCPB
S1-11
BOOT
ROM
32KB
UART
×2
S1-15
D
I
I2S_1
SDMC
I2S_0
JTAG_SEL
Chip_JTAG
S2-00
S1-13
S1-14
IRC
×2
S1-07
USB2.0
Function
PHY
M1-5
USB2.0
Function
DMAC
S2-02
S1-03
DISP
DDR2 Controller
MBUS2AXI
DISP
CAP
DRAW & GEO
HOST IF
AHB2AXI
S2-03
M1-6
IDE66
DMAC
M2-0
M1-7
S1-09
S2-01
M1-8
Wrapper
External
BUS I/F
HBUS2AXI
SRAM
32KB
S1-06
I2S_2
S2-04
CAN
×2
PWM
×2
UART
×2
I2C
×2
ADC
×4
ADC
×2
I2C
×2
CAN
×2
PWM
2ch
SPI
×1
CCNT
UART
×4
UART
×2
Wrapper
D-TCM
16KB
I-Cache
16KB
D-Cache
16KB
JTAG IF
Figure 3-1
Block diagram of MB86R01
CPU core
This is CPU core block of ARM926EJ-S which is connected to each I/O through AHB bus in LSI.
Instruction (I)/Data (D) function as a separate bus master for Harvard architecture.
GDC_TOP
This is MB86296 compatible GDC which has 2 functions: AHB slave function writes required display list
for drawing to GDC with having CPU or DMA controller as master, and AXI master function reads display
list arranged in DDR2 memory with having GDC as master.
AXI bus
This bus bridges main memory and internal resource. Following four bus masters are connected.
AHB1: Each bus master of AHB bus such as CPU and DMA controller
HBUS: HOST IF on GDC
DRAW & GEO: Draw (2D/3D drawing) and GEO (geometry engine) on GDC
MBUS: DISP (display controller) and CAP (Video capture) on GDC
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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