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參數(shù)資料
| 型號： | MB86R01PB-GSE1 |
| 廠商： | Fujitsu Semiconductor America Inc |
| 文件頁數(shù)： | 22/89頁 |
| 文件大小： | 0K |
| 描述： | IC SOC GRAPHIC CONTRLR 484BGA |
| 特色產(chǎn)品： | Graphics Display Controllers (GDC) |
| 標(biāo)準(zhǔn)包裝： | 40 |
| 系列： | 玉 |
| 應(yīng)用： | 圖形控制器 |
| 核心處理器： | ARM9 |
| 程序存儲器類型： | 外部程序存儲器 |
| 控制器系列： | 玉 |
| RAM 容量： | 64K x 8 |
| 接口： | ADC，ATA，CAN，EBI/EMI，I²C，I²S，媒體 LB，PWM，SD 卡，UART/USART，USB |
| 輸入/輸出數(shù)： | 24 |
| 電源電壓： | 1.1 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 484-BGA |
| 包裝： | 托盤 |
| 供應(yīng)商設(shè)備封裝： | 484-BGA（23x23） |
| 其它名稱： | 865-1110 |
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23
FUJITSU MICROELECTRONICS
PROPRIETARY AND CONFIDENTIAL
MB86R01 DATA SHEET
7.2.15.
Video capture related pin
Pin name
I/O
Polarity
Analog
/Digital
Type
Status of pin
after reset
Description
VIN0[7:0]
I
-
D
-
Video capture Data[7:0]
VINVSYNC0
I
-
D
PD
-
Video capture vertical sync input
VINHSYNC0
I
-
D
PD
-
Video capture horizontal sync input
VINFID0
I
-
D
-
Video input field identification signal 0 in odd
field
CCLK0
I
-
D
CLK
-
Video capture input clock
VIN1[7:0]
I
-
D
PD
-
Video capture Data[7:0]
VINVSYNC1
I
-
D
-
Video capture vertical sync input
VINHSYNC1
I
-
D
-
Video capture horizontal sync input
VINFID1
I
-
D
PD
-
Video input field identification signal 0 in odd
field
CCLK1
I
-
D
CLK
-
Video capture input clock
RI1[7:2]
I
-
D
PD
-
NRGB666 capture DataR[7:2] (optional)
GI1[7:2]
I
-
D
PD (*1)
-
NRGB666 capture DataG[7:2] (optional)
BI1[7:2]
I
-
D
PD (*2)
-
NRGB666 capture DataB[7:2] (optional)
*1: GI1[3] is not applicable.
*2: BI1[2] is not applicable.
7.2.16.
System related pin
Pin name
I/O
Polarity
Analog
/Digital
Type
Status of pin
after reset
Description
CLK
I
-
D
CLK
-
Input clock
XRST
I
N
D
ST
-
System reset
CRIPM[3:0]
I
-
D
-
PLLMODE setting
VINITHI
I
-
D
-
Boot high address
PLLBYPASS
I
-
D
-
PLL bypass mode setting
BIGEND
I
-
D
-
LSI endian setting
Low: Little endian
High: Big endian
PLLVSS
I
-
A
-
PLL ground
PLLTDTRST
I
-
D
-
Test pin
Pull up the pin to VDDE, via high resistance
PLLVDD
I
-
A
-
PLL power supply
7.2.17.
JTAG related pin
Pin name
I/O
Polarity
Analog
/Digital
Type
Status of pin
after reset
Description
TCK
I
-
D
ST, PU
-
Test clock
XTRST
I
N
D
ST, PU
-
Test reset
TMS
I
N
D
PU
-
Test mode
TDI
I
-
D
PU
-
Test data input
TDO
O
-
D
Tri
HiZ
Test data output
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| MB86R03PB-GSE1 | 制造商:FUJITSU 功能描述: |
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