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參數(shù)資料
| 型號： | MB86R01PB-GSE1 |
| 廠商： | Fujitsu Semiconductor America Inc |
| 文件頁數(shù)： | 48/89頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC SOC GRAPHIC CONTRLR 484BGA |
| 特色產(chǎn)品： | Graphics Display Controllers (GDC) |
| 標(biāo)準(zhǔn)包裝： | 40 |
| 系列： | 玉 |
| 應(yīng)用： | 圖形控制器 |
| 核心處理器： | ARM9 |
| 程序存儲器類型： | 外部程序存儲器 |
| 控制器系列： | 玉 |
| RAM 容量： | 64K x 8 |
| 接口： | ADC，ATA，CAN，EBI/EMI，I²C，I²S，媒體 LB，PWM，SD 卡，UART/USART，USB |
| 輸入/輸出數(shù)： | 24 |
| 電源電壓： | 1.1 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 484-BGA |
| 包裝： | 托盤 |
| 供應(yīng)商設(shè)備封裝： | 484-BGA（23x23） |
| 其它名稱： | 865-1110 |
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46
FUJITSU MICROELECTRONICS
PROPRIETARY AND CONFIDENTIAL
MB86R01 DATA SHEET
8.4.3.
ADC
Table 8-16
Recommended Operating Conditions
Value
Parameter
Symbol
Min.
Typ.
Max.
Unit
Power supply voltage
AD_AVD0
2.70
3.00
3.60
V
Reference voltage (H)
AD_VRH0
AD_VRH1
AD_AVD0*0.75
–
AD_AVD0
V
Reference voltage (L)
AD_VRL0
AD_VRL1
VSS (*1)
–
AD_AVD0*0.25
V
Decoupling capacitor
AD_VR0 (*2)
AD_VR1 (*2)
0.05
–
μF
Analog input voltage
AD_VIN0
AD_VIN1
AD_VRL0
AD_VRL1
–
AD_VRH0
AD_VRH1
V
Analog input frequency
AD_VIN0
AD_VIN1
0
–
500
kHz
Note:
*1: VSS = AD_AVS1 (analogue GND)
*2: In the case that VR is decoupled with AVS by decoupling capacitor, A/D outputs incorrect result at
immediately after power-on or at the resumption from power down mode.
Because charge current for decoupling capacitors is supplied through the reference resistance, it
takes about 2ms to get correct result (it is the case decoupling capacitor is 0.1F.).
Table 8-17
ADC Characteristics
(VDD = 1.2V, AVD = 3.0V, FS = 100KS/s, FC = 1.4MHz, FVIN = 1 kHz, TA = 25°C (*1))
Value
Parameter
Symbol
Min.
Typ.
Max.
Unit
–
0.8
1.2
mA
Supply current
(included reference current)
AD_AVD0
-1
–
50
A
–
AD_AVD0/2
–
V
Reference voltage (M)
AD_VR0
AD_VR1
-3
–
3
%
Reference resistance
AD_VRH0
AD_VRH1
AD_VRL0
AD_VRL1
7.3
9
10.7
k
Zero transition voltage
(*2)
Typ.
-20
AD_VRL0+1LSB
AD_VRL1+1LSB
Typ.
+20
mV
Full scale transition Voltage
(*2)
Typ.
-20
AD_VRH0-1LSB
AD_VRH1-1LSB
Typ.
+20
mV
Integral non linearity
(*3)
-2.0
–
+2.0
LSB
Differential non linearity
(*3)
-1.5
–
+1.5
LSB
*1: VR is connected to AVS with decoupling capacitor (0.1F).
Unique voltage is supplied to VRH and VRL by voltage source.
*2: VZT and VFST are dependent on chip layout and wiring resistance.
*3: 1LSB = (VFST-VZT)/1022, INLn = ((1LSBxn + VZT) - Vn)/1LSB, DNLn = (Vn + 1 -Vn)/1LSB - 1
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