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參數(shù)資料
| 型號： | MB86R01PB-GSE1 |
| 廠商： | Fujitsu Semiconductor America Inc |
| 文件頁數(shù)： | 18/89頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC SOC GRAPHIC CONTRLR 484BGA |
| 特色產(chǎn)品： | Graphics Display Controllers (GDC) |
| 標(biāo)準(zhǔn)包裝： | 40 |
| 系列： | 玉 |
| 應(yīng)用： | 圖形控制器 |
| 核心處理器： | ARM9 |
| 程序存儲器類型： | 外部程序存儲器 |
| 控制器系列： | 玉 |
| RAM 容量： | 64K x 8 |
| 接口： | ADC，ATA，CAN，EBI/EMI，I²C，I²S，媒體 LB，PWM，SD 卡，UART/USART，USB |
| 輸入/輸出數(shù)： | 24 |
| 電源電壓： | 1.1 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 484-BGA |
| 包裝： | 托盤 |
| 供應(yīng)商設(shè)備封裝： | 484-BGA（23x23） |
| 其它名稱： | 865-1110 |
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19
FUJITSU MICROELECTRONICS
PROPRIETARY AND CONFIDENTIAL
MB86R01 DATA SHEET
7.2.6.
UART related pin
Pin name
I/O
Polarity
Analog
/Digital
Type
Status of pin
after reset
Explanation
UART_SIN0
I
P
D
-
Input data signal
UART_SOUT0
O
P
D
-
H
Output data signal
UART_XCTS0
I
N
D
-
Clear to send
UART_XRTS0
O
N
D
-
H
Request to send
UART_SIN1
I
P
D
-
Input data signal
UART_SOUT1
O
P
D
-
H
Output data signal
UART_SIN2
I
P
D
-
Input data signal
UART_SOUT2
O
P
D
-
H
Output data signal
UART_SIN3
I
P
D
-
Input data signal (optional)
UART_SOUT3
O
P
D
-
H
Output data signal (optional)
UART_SIN4
I
P
D
-
Input data signal (optional)
UART_SOUT4
O
P
D
-
H
Output data signal (optional)
UART_SIN5
I
P
D
-
Input data signal (optional)
UART_SOUT5
O
P
D
-
H
Output data signal (optional)
7.2.7.
CAN related pin
Pin name
I/O
Polarity
Analog
/Digital
Type
Status of pin
after reset
CAN_TX0
O
-
D
PD
H
Transmission (optional)
CAN_RX0
I
-
D
PD
-
Reception (optional)
CAN_TX1
O
-
D
PD
H
Transmission (optional)
CAN_RX1
I
-
D
PD
-
Reception (optional)
7.2.8.
I2S related pin
Pin name
I/O
Polarity
Analog
/Digital
Type
Status of pin
after reset
Explanation
I2S_ECLK0
I
-
D
-
External clock (optional)
I2S_SCK0
IO
-
D
-
HiZ
Clock (optional)
I2S_WS0
IO
PN
D
-
HiZ
Sync (optional)
I2S_SDI0
I
P
D
-
Input data signal (optional)
I2S_SDO0
O
P
D
-
Hiz
Output data signal (optional)
I2S_ECLK1
I
-
D
-
External clock (optional)
I2S_SCK1
IO
-
D
PD
L
Clock (optional)
I2S_WS1
IO
PN
D
PD
L
Sync(optional)
I2S_SDI1
I
P
D
-
Input data signal (optional)
I2S_SDO1
O
P
D
PD
L
Output data signal (optional)
I2S_ECLK2
I
-
D
PD
-
External clock (optional)
I2S_SCK2
IO
-
D
PD
L
Clock (optional)
I2S_WS2
IO
PN
D
PD
L
Sync (optional)
I2S_SDI2
I
P
D
-
Input data signal (optional)
I2S_SDO2
O
P
D
PD
L
Output data signal (optional)
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PDF描述 |
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參數(shù)描述 |
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