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參數資料
| 型號： | LMK04002BISQE/NOPB |
| 廠商： | National Semiconductor |
| 文件頁數： | 51/65頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLOCK COND 1.6GHZ W/PLL 48LLP |
| 標準包裝： | 1 |
| 系列： | PowerWise® |
| 類型： | 時鐘調節(jié)器 |
| PLL： | 是 |
| 輸入： | LVCMOS |
| 輸出： | LVCMOS，2VPECL，LVPECL |
| 電路數： | 1 |
| 比率 - 輸入:輸出： | 2:7 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 1.75GHz |
| 除法器/乘法器： | 是/是 |
| 電源電壓： | 3.15 V ~ 3.45 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 48-WFQFN 裸露焊盤 |
| 供應商設備封裝： | 48-LLP（7x7） |
| 包裝： | 標準包裝 |
| 產品目錄頁面： | 1275 (CN2011-ZH PDF) |
| 其它名稱： | LMK04002BISQEDKR |
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0.1 PF
LMK040XX
Input
1
0
:
100: Trace
(Differential)
Differential
Sinewave Clock
Source
CLKinX
CLKinX*
SNOSAZ8J – SEPTEMBER 2008 – REVISED SEPTEMBER 2011
DRIVING CLKin AND OSCin INPUTS
Driving CLKin Pins with a Differential Source
Both CLKin ports can be driven by differential signals. It is recommended that the input mode be set to bipolar
(CLKinX_TYPE = 0) when using differential reference clocks. The LMK04000 family internally biases the input
pins so the differential interface should be AC coupled. The recommended circuits for driving the CLKin pins with
either LVDS or LVPECL are shown in Figure 27 and Figure 28.
Figure 27. CLKinX/X* Termination for an LVDS Reference Clock Source
Figure 28. CLKinX/X* Termination for an LVPECL Reference Clock Source
Finally, a reference clock source that produces a differential sinewave output can drive the CLKin pins using the
following circuit. Note: the signal level must conform to the requirements for the CLKin pins listed in the Electrical
Characteristics table.
Figure 29. CLKinX/X* Termination for a Differential Sinewave Reference Clock Source
Driving CLKin Pins with a Single-Ended Source
The CLKin pins of the LMK04000 family can be driven using a single-ended reference clock source, for example,
either a sinewave source or an LVCMOS/LVTTL source. Either AC coupling or DC coupling may be used. In the
case of the sinewave source that is expecting a 50
Ω load, it is recommended that AC coupling be used as
shown in the circuit below with a 50
Ω termination..
NOTE
The signal level must conform to the requirements for the CLKin pins listed in the
Electrical Characteristics table. CLKinX_TYPE in Register 11 is recommended to be set to
bipolar mode (CLKinX_TYPE = 0).
Copyright 2008–2011, Texas Instruments Incorporated
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相關PDF資料 |
PDF描述 |
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相關代理商/技術參數 |
參數描述 |
|---|---|
| LMK04002BISQX | 制造商:NSC 制造商全稱:National Semiconductor 功能描述:Low-Noise Clock Jitter Cleaner with Cascaded PLLs |
| LMK04002BISQX/NOPB | 功能描述:時鐘合成器/抖動清除器 RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel |
| LMK04010BISQ | 制造商:NSC 制造商全稱:National Semiconductor 功能描述:Low-Noise Clock Jitter Cleaner with Cascaded PLLs |
| LMK04010BISQ/NOPB | 功能描述:時鐘合成器/抖動清除器 RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel |
| LMK04010BISQE | 制造商:NSC 制造商全稱:National Semiconductor 功能描述:Low-Noise Clock Jitter Cleaner with Cascaded PLLs |
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