參數資料
型號： ICS1892Y-14
英文描述： 10Base-T/100Base-TX Integrated PHYceiver
文件頁數： 140/148頁
文件大小： 816K
代理商： ICS1892Y-14
ICS1892, Rev. D, 2/26/01
February 26, 2001
140
Chapter 10
DC and AC Operating Conditions
ICS1892 Data Sheet
2000-2001, Integrated Circuit Systems, Inc.
All rights reserved.
10.5.17
Reset: Hardware Reset and Power-Down
Table 10-24
lists the significant time periods for the hardware reset and power-down reset (which consists
of timings of signals on the REF_IN, RESET*, and TXCLK pins).
Figure 10-17
shows the timing diagram for
the time periods.
Figure 10-17.
Hardware Reset and Power-Down Timing Diagram
Table 10-24.
Hardware Reset and Power-Down Timing
Time
Period
Parameter
Conditions
Min.
Typ.
Max.
Units
t1
RESET* Active to Device Isolation and
Initialization
–
–
65
–
ns
t2
Minimum RESET* Pulse Width
–
200
–
–
ns
t3
RESET* Released to TXCLK Valid
–
–
53
200
ms
REF_IN
RESET*
TXCLK
Valid
Power
Consumption
(AC only)
t1
t2
t3
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PDF描述
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