參數(shù)資料
型號： HYB18T512800AC-37
廠商： INFINEON TECHNOLOGIES AG
英文描述： M39012 MIL RF CONNECTOR
中文描述： 512兆雙數(shù)據(jù)速率2內(nèi)存
文件頁數(shù)： 32/96頁
文件大?。?/td> 2153K
代理商： HYB18T512800AC-37
HYB18T512[400/800/160]A[C/F]–[3.7/5]
512-Mbit Double-Data-Rate-Two SDRAM
Functional Description
Data Sheet
32
Rev. 1.13, 2004-05
09112003-SDM9-IQ3P
ODT Truth Tables
The ODT Truth Table shows which of the input pins are
terminated depending on the state of address bit A10
and A11 in the EMRS(1) for all three device
organisations (
×
4,
×
8 and
×
16). To activate termination
of any of these pins, the ODT function has to be
enabled in the EMRS(1) by address bits A6 and A2.
Note:X = don’t care; 0 = bit set to low; 1 = bit set to high
ODT timing modes
Depending on the operating mode synchronous or
asynchronous ODT timings apply. Synchronous
timings (
t
AOND
,
t
AOFD
,
t
AON
and
t
AOF
) apply for all modes,
when the on-die DLL is enabled.
These modes are:
Active Mode
Standby Mode
Fast Exit Active Power Down Mode (with MRS bit
A12 is set to “0”)
Asynchronous ODT timings (
t
AOFPD
,
t
AONPD
) apply when
the on-die DLL is disabled.
These modes are:
Slow Exit Active Power Down Mode (with MRS bit
A12 is set to “1”)
Precharge Power Down Mode
Table 11
Input Pin
ODT Truth Table
EMRS(1)
Address Bit A10
EMRS(1)
Address Bit A11
×
4 components
DQ[3:0]
DQS
DQS
DM
×
8 components
DQ[7:0]
DQS
DQS
RDQS
RDQS
DM
×
16 components
DQ[15:0]
LDQS
LDQS
UDQS
UDQS
LDM
UDM
X
X
0
X
X
X
X
X
X
X
0
X
0
X
X
X
X
1
1
0
X
X
0
X
0
X
X
X
X
X
X
X
X
X
相關(guān)PDF資料
PDF描述
HYB18T512800AC-5 M39012 MIL RF CONNECTOR
HYB18T512800AC DDR2 Registered Memory Modules
HYB18T512800AF DDR2 Registered Memory Modules
HYB18T512800AF-37 512-Mbit Double-Data-Rate-Two SDRAM
HYB18T512800AF-5 512-Mbit Double-Data-Rate-Two SDRAM
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參數(shù)描述
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