參數(shù)資料
型號： DSPB56366AG120
廠商： Freescale Semiconductor
文件頁數(shù)： 80/110頁
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描述： IC DSP 24BIT AUD 120MHZ 144-LQFP
產(chǎn)品變化通告： Product Discontinuation 24/Feb/2012
標準包裝： 60
系列： DSP56K/Symphony
類型： 音頻處理器
接口： 主機接口，I²C，SAI，SPI
時鐘速率： 120MHz
非易失內(nèi)存： ROM（240 kB）
芯片上RAM： 69kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 3.30V
工作溫度： -40°C ~ 110°C
安裝類型： 表面貼裝
封裝/外殼： 144-LQFP
供應(yīng)商設(shè)備封裝： 144-LQFP（20x20）
包裝： 托盤
DSP56366 Technical Data, Rev. 3.1
Freescale Semiconductor
3-45
152
SCK edge to data out valid
(data out delay time)
Master/Slave
Bypassed
2
×T
C+33
—
49.7
ns
Narrow
2
×T
C+123
—
139.7
ns
Wide
2
×T
C+210
—
226.7
ns
153
SCK edge to data out not valid
(data out hold time)
Master/Slave
Bypassed
TC+5
13.3
—
ns
Narrow
TC+55
63.3
—
ns
Wide
TC+106
114.3
—
ns
154
SS assertion to data out valid
(CPHA = 0)
Slave
—
TC+33
—
41.3
ns
157
First SCK sampling edge to HREQ output
deassertion
Slave
Bypassed
2.5
×T
C+30
—
50.8
ns
Narrow
2.5
×T
C+120
—
140.8
ns
Wide
2.5
×T
C+217
—
237.8
ns
158
Last SCK sampling edge to HREQ output
not deasserted (CPHA = 1)
Slave
Bypassed
2.5
×T
C+30
50.8
—
ns
Narrow
2.5
×T
C+80
100.8
—
ns
Wide
2.5
×T
C+136
156.8
—
ns
159
SS deassertion to HREQ output not
deasserted (CPHA = 0)
Slave
—
2.5
×T
C+30
50.8
—
ns
160
SS deassertion pulse width (CPHA = 0)
Slave
—
TC+6
14.3
—
ns
161
HREQ in assertion to first SCK edge
Master
Bypassed
0.5
× t
SPICC +
2.5
×T
C+43
111.8
—
ns
Narrow
0.5
×t
SPICC +
2.5
×T
C+43
164.8
—
ns
Wide
0.5
×t
SPICC +
2.5
×T
C+43
200.3
—
ns
162
HREQ in deassertion to last SCK
sampling edge (HREQ in set-up time)
(CPHA = 1)
Master
—
0
—
ns
163
First SCK edge to HREQ in not asserted
(HREQ in hold time)
Master
—
0
—
ns
1 V
CC = 3.16 V ± 0.16 V; TJ = –40°C to +110°C, CL = 50 pF
2 Periodically sampled, not 100% tested
Table 3-19 Serial Host Interface SPI Protocol Timing (continued)
No.
Characteristics1
Mode
Filter
Mode
Expression
Min
Max
Unit
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