Table 3-16 DRAM Out-of-Page and Refresh Timings, Fifteen Wait States
參數(shù)資料
型號(hào)： DSPB56366AG120
廠商： Freescale Semiconductor
文件頁數(shù)： 64/110頁
文件大?。?/td> 0K
描述： IC DSP 24BIT AUD 120MHZ 144-LQFP
產(chǎn)品變化通告： Product Discontinuation 24/Feb/2012
標(biāo)準(zhǔn)包裝： 60
系列： DSP56K/Symphony
類型： 音頻處理器
接口： 主機(jī)接口，I²C，SAI，SPI
時(shí)鐘速率： 120MHz
非易失內(nèi)存： ROM（240 kB）
芯片上RAM： 69kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 3.30V
工作溫度： -40°C ~ 110°C
安裝類型： 表面貼裝
封裝/外殼： 144-LQFP
供應(yīng)商設(shè)備封裝： 144-LQFP（20x20）
包裝： 托盤
DSP56366 Technical Data, Rev. 3.1
Freescale Semiconductor
3-31
Table 3-16 DRAM Out-of-Page and Refresh Timings, Fifteen Wait States1, 2
No.
Characteristics3
Symbol
Expression
Min
Max
Unit
157
Random read or write cycle time
tRC
16
× T
C
133.3
—
ns
158
RAS assertion to data valid (read)
tRAC
8.25
× T
C 5.7
—
63.0
ns
159
CAS assertion to data valid (read)
tCAC
4.75
× T
C 5.7
—
33.9
ns
160
Column address valid to data valid (read)
tAA
5.5
× T
C 5.7
—
40.1
ns
161
CAS deassertion to data not valid (read hold time)
tOFF
0.0
—
ns
162
RAS deassertion to RAS assertion
tRP
6.25
× T
C 4.0
48.1
—
ns
163
RAS assertion pulse width
tRAS
9.75
× T
C 4.0
77.2
—
ns
164
CAS assertion to RAS deassertion
tRSH
6.25
× T
C 4.0
48.1
—
ns
165
RAS assertion to CAS deassertion
tCSH
8.25
× T
C 4.0
64.7
—
ns
166
CAS assertion pulse width
tCAS
4.75
× T
C 4.0
35.6
—
ns
167
RAS assertion to CAS assertion
tRCD
3.5
× T
C ± 2
27.2
31.2
ns
168
RAS assertion to column address valid
tRAD
2.75
× T
C ± 2
20.9
24.9
ns
169
CAS deassertion to RAS assertion
tCRP
7.75
× T
C 4.0
60.6
—
ns
170
CAS deassertion pulse width
tCP
6.25
× T
C 4.0
48.1
—
ns
171
Row address valid to RAS assertion
tASR
6.25
× T
C 4.0
48.1
—
ns
172
RAS assertion to row address not valid
tRAH
2.75
× T
C 4.0
18.9
—
ns
173
Column address valid to CAS assertion
tASC
0.75
× T
C 4.0
2.2
—
ns
174
CAS assertion to column address not valid
tCAH
6.25
× T
C 4.0
48.1
—
ns
175
RAS assertion to column address not valid
tAR
9.75
× T
C 4.0
77.2
—
ns
176
Column address valid to RAS deassertion
tRAL
7
× T
C 4.0
54.3
—
ns
177
WR deassertion to CAS assertion
tRCS
5
× T
C 3.8
37.9
—
ns
178
CAS deassertion to WR4 assertion
tRCH
1.75
× T
C 3.7
10.9
—
ns
179
RAS deassertion to WR5 assertion
tRRH
0.25
× T
C 2.0
0.1
—
ns
180
CAS assertion to WR deassertion
tWCH
6
× T
C 4.2
45.8
—
ns
181
RAS assertion to WR deassertion
tWCR
9.5
× T
C 4.2
75.0
—
ns
182
WR assertion pulse width
tWP
15.5
× T
C 4.5
124.7
—
ns
183
WR assertion to RAS deassertion
tRWL
15.75
× T
C 4.3
126.9
—
ns
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