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參數(shù)資料
| 型號： | DSP56F827FG80E |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 38/60頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC HYBRID CTRLR 16BIT 128-LQFP |
| 標(biāo)準(zhǔn)包裝： | 72 |
| 系列： | 56F8xx |
| 核心處理器： | 56800 |
| 芯體尺寸： | 16-位 |
| 速度： | 80MHz |
| 連通性： | EBI/EMI，SCI，SPI，SSI |
| 外圍設(shè)備： | POR，PWM，WDT |
| 輸入/輸出數(shù)： | 64 |
| 程序存儲器容量： | 136KB（68K x 16） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 5K x 16 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.25 V ~ 2.75 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 10x12b |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 128-LQFP |
| 包裝： | 托盤 |
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Synchronous Serial Interface (SSI) Timing
56F827 Technical Data, Rev. 12
Freescale Semiconductor
43
1.
Parasitic capacitance due to package, pin to pin, and pin to package base coupling. (1.8pf)
2.
Parasitic capacitance due to the chip bond pad, ESD protection devices and signal routing. (2.04pf)
3.
Equivalent resistance for the ESD isolation resistor and the channel select mux. (500 ohms)
4.
Sampling capacitor at the sample and hold circuit. Capacitor 4 is normally disconnected from the input and is only
connected to it at sampling time. (1pf)
Figure 3-24 Equivalent Analog Input Circuit
3.11 Synchronous Serial Interface (SSI) Timing
2. Measured in 10-90% range.
3. LSB = Least Significant Bit.
4. Guaranteed by characterization.
5. tAIC = 1/fADIC
Table 3-14 SSI Master Mode1 Switching Characteristics
Operating Conditions: VSSIO=VSS = VSSA = 0V, VDDA =VDDIO=3.0–3.6V, VDD = 2.25–2.75V, TA = –40° to +85°C, CL < 50pF, fop = 80MHz
Parameter
Symbol
Min
Typ
Max
Units
STCK frequency
fs
—
102
MHz
STCK period3
tSCKW
100
—
ns
STCK high time
tSCKH
504
——
ns
STCK low time
tSCKL
504
——
ns
Output clock rise/fall time
—
4
—
ns
Delay from STCK high to STFS (bl) high - Master5
tTFSBHM
0.1
—
0.5
ns
Delay from STCK high to STFS (wl) high - Master5
tTFSWHM
0.1
—
0.5
ns
Delay from SRCK high to SRFS (bl) high - Master5
tRFSBHM
0.6
—
1.3
ns
Delay from SRCK high to SRFS (wl) high - Master5
tRFSWHM
0.6
—
1.3
ns
Delay from STCK high to STFS (bl) low - Master5
tTFSBLM
-1.0
—
-0.1
ns
1
2
3
4
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