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參數(shù)資料
| 型號(hào)： | DDP3310B |
| 廠(chǎng)商： | MICRONAS SEMICONDUCTOR HOLDING AG |
| 元件分類(lèi)： | 消費(fèi)家電 |
| 英文描述： | Display and Deflection Processor |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PQCC68 |
| 封裝： | PLASTIC, LCC-68 |
| 文件頁(yè)數(shù)： | 49/60頁(yè) |
| 文件大?。?/td> | 1540K |
| 代理商： | DDP3310B |
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ADVANCE INFORMATION
DDP 3310B
Micronas
49
4.6.4.7. Horizontal and Vertical Sync Inputs and Clock and Freqency Select Pins
Fig. 4
–
23:
Sync Inputs referenced to line-locked clock
4.6.4.8. Horizontal Flyback Input
4.6.4.9. FIFO Control Signals
Symbol
Parameter
Pin Name
Min.
Typ.
Max.
Unit
Test Conditions
V
IL
Input Low Voltage
HS
VS
VS2
CM0
CM1
FREQSEL
0.8
V
V
IH
Input High Voltage
2.0
V
C
IN
Input Capacitance
5
pF
t
IS
Input Setup Time
HS
VS
VS2
6
ns
t
IH
Input Hold Time
7
ns
Symbol
Parameter
Pin Name
Min.
Typ.
Max.
Unit
Test Conditions
V
IL
Input Low Voltage
HFLB
1.8
V
V
IH
Input High Voltage
2.6
V
V
IHST
Input Hysteresis
0.1
V
Symbol
Parameter
Pin Name
Min.
Typ.
Max.
Unit
Test Conditions
V
OL
Output Low Voltage
FIFORRD
FIFORD
FIFORWR
FIFOWR
0.4
V
I
OL
= 1.6 mA
I
2
C[PSTSY] = 6
V
OH
Output High Voltage
VSUPP
0.4
VSUPP
V
I
OL
= 1.6 mA
I
2
C[PSTSY] = 6
t
OT
Output Transition Time
10
20
ns
C
LOAD
= 30pF
I
2
C[PSTSY] = 6
I
OL
Output Current
10
10
mA
HS, VS, VS2 Inputs
t
IS
t
IH
V
IH
V
IL
V
IH
V
IL
LLC1
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PDF描述 |
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