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參數(shù)資料
| 型號(hào)： | DDP3310B |
| 廠(chǎng)商： | MICRONAS SEMICONDUCTOR HOLDING AG |
| 元件分類(lèi)： | 消費(fèi)家電 |
| 英文描述： | Display and Deflection Processor |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PQCC68 |
| 封裝： | PLASTIC, LCC-68 |
| 文件頁(yè)數(shù)： | 46/60頁(yè) |
| 文件大小： | 1540K |
| 代理商： | DDP3310B |
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DDP 3310B
ADVANCE INFORMATION
46
Micronas
4.6.4.2. Line-locked Clock Inputs: LLC1, LLC2
(see Fig. 4
–
21)
4.6.4.3. Luma, Chroma Inputs
(see Fig. 4
–
21)
Fig. 4
–
21:
Line-locked clock input pins and luma/chroma bus input timing
Symbol
Parameter
Pin Name
Min.
Typ.
Max.
Unit
Test Conditions
V
IL
Input Low Voltage
LLC1
LLC2
0.8
V
V
IH
Input High Voltage
2.0
V
t
SK
Clock skew
±
6
ns
t
R
, t
F
Clock Rise / Fall Time
5
ns
C
IN
Input Capacitance
5
pF
1/T
LLC1
Clock Frequency
LLC1
12.0
17.2
MHz
t
WL1
Clock Low Time
26
ns
t
WH1
Clock High Time
26
ns
1/T
LLC2
Clock Frequency
LLC2
25.1
43.3
MHz
t
WL2
Clock Low Time
7
ns
t
WH2
Clock High Time
7
ns
Symbol
Parameter
Pin Name
Min.
Typ.
Max.
Unit
Test Conditions
V
IL
Input Low Voltage
Y[0...7]
C[0...7]
0.8
V
V
IH
Input High Voltage
2.0
V
t
IS
Input Setup Time
7
ns
t
IH
Input Hold Time
6
ns
C
IN
Input Capacitance
5
pF
Y,C Inputs
LLC2
t
IS
t
IH
LLC1
V
IH
V
IL
V
IH
V
IL
t
SK
t
SK
t
R2
t
F2
t
WL2
t
WH2
T
LLC2
t
WL1
t
WH1
t
R1
t
F1
T
LLC1
V
IH
V
IL
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PDF描述 |
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