參數(shù)資料
型號(hào)： CWMPCEVB5200BE
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 48/72頁(yè)
文件大?。?/td> 0K
描述： BOARD MPC5200B W/256MB
標(biāo)準(zhǔn)包裝： 1
類型： MPU
適用于相關(guān)產(chǎn)品： MPC5200B
所含物品： 板
MPC5200B Data Sheet, Rev. 4
52
Freescale Semiconductor
Figure 42. Timing Diagram — SPI Slave Mode, Format 0 (CPHA = 0)
NOTE
Output timing is specified at a nominal 50 pF load.
Table 48. Timing Specifications — SPI Master Mode, Format 1 (CPHA = 1)
Sym
Description
Min
Max
Units
SpecID
1
SCK cycle time, programable in the PSC CCS register
30.0
—
ns
A15.46
2
SCK pulse width, 50% SCK duty cycle
15.0
—
ns
A15.47
3
Slave select clock delay, programable in the PSC CCS register
30.0
—
ns
A15.48
4
Output data valid
—
8.9
ns
A15.49
5
Input Data setup time
6.0
—
ns
A15.50
6
Input Data hold time
1.0
—
ns
A15.51
7
Slave disable lag time
—
8.9
ns
A15.52
8
Sequential Transfer delay, programable in the PSC CTUR / CTLR
register
15.0
—
ns
A15.53
9
Clock falling time
—
7.9
ns
A15.54
10
Clock rising time
—
7.9
ns
A15.55
SCK
(CLKPOL=0)
SCK
(CLKPOL=1)
MOSI
Input
SS
Input
MISO
Output
1
22
9
3
7
4
6
5
8
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PDF描述
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