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參數(shù)資料
| 型號(hào)： | CS4205-KQZ |
| 廠商： | Cirrus Logic Inc |
| 文件頁(yè)數(shù)： | 44/81頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC CODEC AC97 I2S 48-LQFP |
| 標(biāo)準(zhǔn)包裝： | 250 |
| 類型： | 音頻編解碼器 '97 |
| 數(shù)據(jù)接口： | 串行 |
| 分辨率（位）： | 18，20 b |
| ADC / DAC 數(shù)量： | 1 / 2 |
| 三角積分調(diào)變： | 是 |
| 動(dòng)態(tài)范圍，標(biāo)準(zhǔn) ADC / DAC (db)： | 90 / 90 |
| 電壓 - 電源，模擬： | 4.75 V ~ 5.25 V |
| 電壓 - 電源，數(shù)字： | 4.75 V ~ 5.25 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 48-LQFP |
| 供應(yīng)商設(shè)備封裝： | 48-TQFP（9x9） |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁(yè)面： | 754 (CN2011-ZH PDF) |
| 其它名稱： | 598-1182 |
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CS4205
DS489PP4
49
5.33
Signal Processing Engine Control Register (Index 6Eh, Address 08h)
SDI1M
Serial Data Input 1 Mode. The SDI1M bit controls the flow of data from the first serial data input
into the signal processing engine. If this bit is ‘0’, the two channels of the SDI1 port are routed to
their respective channels of the SDI1 volume control. If this bit is ‘1’, the left channel of the SDI1
port is routed to both, the left and right channels of the SDI1 volume control.
SRZC[1:0]
Soft Ramp and Zero Cross Control. The SRZC bits control when changes take effect on the dig-
ital volume controls. Table 19 lists the available settings.
LPFS[1:0]
Low Pass Filter Select. The LPFS[1:0] bits select the center frequency of the low pass filter for
the EQ algorithm. Table 19 lists the available settings.
HPFS[1:0]
High Pass Filter Select. The HPFS[1:0] bits select the center frequency of the high pass filter for
the EQ algorithm. Table 19 lists the available settings.
GL[3:0]
Effects Engine Left Output Volume. The GL[3:0] bits are used to control the effects engine left
channel output volume. Each step corresponds to 1 dB gain adjustment, with 0000 = 0 dB atten-
uation. The total range is 0 dB to -15 dB attenuation.
GR[3:0]
Effects Engine Right Output Volume. The GR[3:0] bits are used to control the effects engine right
channel output volume. Each step corresponds to 1 dB gain adjustment, with 0000 = 0 dB atten-
uation. The total range is 0 dB to -15 dB attenuation.
Default
1800h
If the digital effects engine signals an overflow condition by setting the ELOF or EROF bit in the IEC Status Register
(Index 6Eh, Address 0B), the controller should correct the error by reducing the effects engine output volume in this
register.
D15
D14
D13
D12
D11
D10
D9
D8
D7
D6
D5
D4
D3
D2
D1
D0
Res
SDI1M SRZC1 SRZC0 LPFS1 LPFS0 HPFS1 HPFS0
GL3
GL2
GL1
GL0
GR3
GR2
GR1
GR0
SRZC[1:0]
LPFS[1:0]
HPFS[1:0]
Volume Change Mode
Low Pass
Filter
High Pass
Filter
00
immediately
20 Hz
10 kHz
01
on zero crossings
50 Hz
15 kHz
10
soft ramp (1/8 dB step per frame)
100 Hz
20 kHz
11
1/8 dB step per zero crossing
reserved
Table 19. Volume Change Modes and EQ Filter Selects
相關(guān)PDF資料 |
PDF描述 |
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| CS4270-DZZ | IC CODEC 24BIT 105DB 24TSSOP |
| CS4271-DZZ | IC CODEC 24BIT 114DB 28-TSSOP |
| CS4272-DZZ | IC CODEC 24BIT 114DB 28-TSSOP |
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參數(shù)描述 |
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| CS4207-CNZR | 功能描述:接口—CODEC IC Lo Pwr,4/6 HD Aud Codec w/HP Amp RoHS:否 制造商:Texas Instruments 類型: 分辨率: 轉(zhuǎn)換速率:48 kSPs 接口類型:I2C ADC 數(shù)量:2 DAC 數(shù)量:4 工作電源電壓:1.8 V, 2.1 V, 2.3 V to 5.5 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DSBGA-81 封裝:Reel |
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