參數(shù)資料
型號： C8051F300DK
廠商： Silicon Laboratories Inc
文件頁數(shù)： 99/178頁
文件大?。?/td> 0K
描述： DEV KIT F300/301/302/303/304/305
標準包裝： 1
類型： MCU
適用于相關產品： Silicon Laboratories C8051 F300/001/002
所含物品： 評估板，電源，USB 線纜，適配器和文檔
產品目錄頁面： 626 (CN2011-ZH PDF)
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336-1186-ND - IC 8051 MCU 32K FLASH 32LQFP
336-1185-ND - IC 8051 MCU 32K FLASH 48TQFP
其它名稱： 336-1246
Rev. 2.9
27
C8051F300/1/2/3/4/5
4.
Pinout and Package Definitions
Table 4.1. Pin Definitions for the C8051F300/1/2/3/4/5
Name
Pin
F300/1/2/3/4/5
GM
Pin
F300/1/2/3/4/5
GP
Type
Description
VREF /
P0.0
1
5
A In
D I/O or
A In
External Voltage Reference Input.
Port 0.0. See Section 12 for complete description.
P0.1
2
6
D I/O or
A In
Port 0.1. See Section 12 for complete description.
VDD
3
7
Power Supply Voltage.
XTAL1 /
P0.2
4
8
A In
D I/O or
A In
Crystal Input. This pin is the external oscillator cir-
cuit return for a crystal or ceramic resonator. See
Port 0.2. See Section 12 for complete description.
XTAL2 /
P0.3
5
10
A Out
D I/O
Crystal Input/Output. For an external crystal or res-
onator, this pin is the excitation driver. This pin is
the external clock input for CMOS, capacitor, or RC
network configurations. See Section 11.2.
Port 0.3. See Section 12 for complete description.
P0.4
6
12
D I/O or
A In
Port 0.4. See Section 12 for complete description.
P0.5
7
13
D I/O or
A In
Port 0.5. See Section 12 for complete description.
C2CK /
RST
8
14
D I/O
Clock signal for the C2 Development Interface.
Device Reset. Open-drain output of internal POR or
VDD monitor. An external source can initiate a sys-
tem reset by driving this pin low for at least 10 s.
P0.6 /
CNVSTR
9
1
D I/O or
A In
D I/O
Port 0.6. See Section 12 for complete description.
ADC External Convert Start Input Strobe.
C2D /
P0.7
10
2
D I/O
D I/O or
A In
Data signal for the C2 Development Interface.
Port 0.7. See Section 12 for complete description.
GND
11
3
Ground.
N.C. pins for F30x GP packages: 4, 9, 11
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PDF描述
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