參數(shù)資料
型號： C8051F005
廠商： Cygnal Technologies
英文描述： 25 MIPS,32k Flash,2.25k Ram,12bit ADC,64 Pin MCU(25 MIPS,32k 閃速存儲器,2.25k Ram,12位 ADC,64 腳 MCU)
中文描述： 25 MIPS的，32K閃存，2.25k羊，12位ADC，64引腳微控制器（25 MIPS的，32K的閃速存儲器，2.25k羊，12位ADC和64腳微控制器）
文件頁數(shù)： 123/170頁
文件大小： 1294K
代理商： C8051F005
4.2001; Rev. 1.3
CYGNAL Integrated Products, Inc.
2001
Page 123
C8051F000/1/2/5/6/7
C8051F010/1/2/5/6/7
PRELIMINARY
Figure 17.2. Typical SPI Interconnection
17.1.
The four signals used by the SPI (MOSI, MISO, SCK, NSS) are described below.
17.1.1. Master Out, Slave In
The master-out, slave-in (MOSI) signal is an output from a master device and an input to slave devices. It is used to
serially transfer data from the master to the slave. Data is transferred most-significant bit first.
17.1.2. Master In, Slave Out
The master-in, slave-out (MISO) signal is an output from a slave device and an input to the master device. It is used
to serially transfer data from the slave to the master. Data is transferred most-significant bit first. A SPI slave
places the MISO pin in a high-impedance state when the slave is not selected.
17.1.3. Serial Clock
The serial clock (SCK) signal is an output from the master device and an input to slave devices. It is used to
synchronize the transfer of data between the master and slave on the MOSI and MISO lines.
17.1.4. Slave Select
The slave select (NSS) signal is an input used to select the SPI module when in slave mode by a master, or to disable
the SPI module when in master mode. When in slave mode, it is pulled low to initiate a data transfer and remains
low for the duration of the transfer.
Signal Descriptions
Master
Device
MOSI
SCK
Slave
Device
NSS
Slave
Device
NSS
Slave
Device
MISO
P
NSS
VDD
P
P
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PDF描述
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