tSL
參數(shù)資料
型號： ADUC814BRUZ
廠商： Analog Devices Inc
文件頁數(shù)： 63/72頁
文件大?。?/td> 0K
描述： IC ADC 12BIT W/FLASH MCU 28TSSOP
標(biāo)準(zhǔn)包裝： 50
系列： MicroConverter® ADuC8xx
核心處理器： 8052
芯體尺寸： 8-位
速度： 16.78MHz
連通性： I²C，SPI，UART/USART
外圍設(shè)備： POR，PSM，溫度傳感器，WDT
輸入/輸出數(shù)： 17
程序存儲器容量： 8KB（8K x 8）
程序存儲器類型： 閃存
EEPROM 大?。?/td> 640 x 8
RAM 容量： 256 x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 6x12b; D/A 2x12b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 125°C
封裝/外殼： 28-TSSOP（0.173"，4.40mm 寬）
包裝： 管件
產(chǎn)品目錄頁面： 738 (CN2011-ZH PDF)
配用： EVAL-ADUC814QSZ-ND - KIT DEV FOR ADUC814 MICROCONVRTR
ADuC814
Rev. A | Page 66 of 72
Table 36. SPI Master Mode Timing (CPHA = 1)
Parameter
Min
Typ
Max
Unit
tSL
SCLOCK Low Pulse Width1
630
ns
tSH
SCLOCK High Pulse Width1
630
ns
tDAV
Data Output Valid after SCLOCK Edge
50
ns
tDSU
Data Input Setup Time before SCLOCK Edge
100
ns
tDHD
Data Input Hold Time after SCLOCK Edge
100
ns
tDF
Data Output Fall Time
10
25
ns
tDR
Data Output Rise Time
10
25
ns
tSR
SCLOCK Rise Time
10
25
ns
tSF
SCLOCK Fall Time
10
25
ns
1 Characterized under the following conditions:
a. Core clock divider bits CD2, CD1, and CD0 in PLLCON SFR set to 0, 1, and 1, respectively, i.e., core clock frequency = 2.09 MHz.
b. SPI bit-rate selection bits SPR1 and SPR0 bits in SPICON SFR set to 0 and 0, respectively.
SCLOCK
(CPOL = 0)
SCLOCK
(CPOL = 1)
MOSI
MISO
MSB
LSB
LSB IN
BITS 6–1
MSB IN
tDAV
tDSU
tDHD
tDR
tDF
tSH
tSL
tSR
tSF
02748-A
-005
Figure 63. SPI Master Mode Timing (CPHA = 1)
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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