參數(shù)資料
型號： ADUC7034BCPZ
廠商： Analog Devices Inc
文件頁數(shù)： 90/136頁
文件大?。?/td> 0K
描述： IC MCU FLASH 32K ANLG IO 48LFCSP
標(biāo)準(zhǔn)包裝： 1
系列： MicroConverter® ADuC7xxx
核心處理器： ARM7
芯體尺寸： 16/32-位
速度： 20.48MHz
連通性： LIN，SPI，UART/USART
外圍設(shè)備： POR，PSM，溫度傳感器，WDT
輸入/輸出數(shù)： 9
程序存儲(chǔ)器容量： 32KB（16K x 16）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 1K x 32
電壓 - 電源 (Vcc/Vdd)： 3.5 V ~ 18 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 2x16b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 115°C
封裝/外殼： 48-VFQFN 裸露焊盤，CSP
包裝： 托盤
ADuC7034
Rev. B | Page 57 of 136
AT
T
E
N
UAT
IO
N
(
d
B
)
FREQUENCY (kHz)
–100
0
–10
–20
–30
–40
–50
–60
–70
–80
–90
0
0.5
1.5
2.5
3.5
4.0
4.5
3.0
2.0
1.0
5.0
07
11
6-
0
20
Figure 22. Modified Sinc3 Digital Filter Response at fADC = 1 kHz
(ADCFLT = 0x0087)
In ADC normal power mode, the maximum ADC throughput
rate is 8 kHz. This is configured by setting the SF and AF bits in
the ADCFLT MMR to 0 with all other filtering options disabled.
As a result, 0x0000 is written to ADCFLT. Figure 23 shows a
typical 8 kHz filter response based on these settings.
–100
0
–10
–20
–30
–40
–50
–60
–70
–80
–90
02468
10
12
14
16
18
20
22
24
AT
T
E
NUA
T
IO
N
(
d
B)
FREQUENCY (kHz)
07
11
6-
0
21
Figure 23. Typical Digital Filter Response at fADC = 8 kHz (ADCFLT = 0x0000)
A modified version of the 8 kHz filter response can be configured
by setting the running average bit (ADCFLT[14]). As a result,
an additional running-average-by-two filter is introduced on all
ADC output samples, which further reduces the ADC output
noise. In addition, by maintaining an 8 kHz ADC throughput
rate, the ADC settling time is increased by one full conversion
period. The modified frequency response for this configuration
is shown in Figure 24.
–100
0
–10
–20
–30
–40
–50
–60
–70
–80
–90
0
2468
10
12
14
16
18
20
22
24
AT
T
E
NUA
T
IO
N
(
d
B)
FREQUENCY (kHz)
07
11
6-
02
2
Figure 24. Typical Digital Filter Response at fADC = 8 kHz (ADCFLT = 0x4000)
At very low throughput rates, the chop bit in the ADCFLT
register can be enabled to minimize offset errors and, more
importantly, temperature drift in the ADC offset error. With
chop enabled, there are two primary variables (sinc3 decimation
factor and averaging factor) available to allow the user to select
an optimum filter response, but there is a trade-off between
filter bandwidth and ADC noise.
For example, with the chop enable bit (ADCFLT[15]) set to 1,
the SF value (ADCFLT[6:0]) increases to 0x1F (31 decimal) and
an AF value (ADCFLT[13:8]) of 0x16 (22 decimal) is selected,
resulting in an ADC throughput of 10 Hz. The frequency
response in this case is shown in Figure 25.
–100
0
–10
–20
–30
–40
–50
–60
–70
–80
–90
0
200
180
160
140
120
100
80
60
40
20
AT
T
E
NUA
T
IO
N
(
d
B)
FREQUENCY (kHz)
07
11
6-
02
3
Figure 25. Typical Digital Filter Response at fADC = 10 Hz (ADCFLT = 0x961F)
Changing SF to 0x1D and setting AF to 0x3F with the chop bit
still enabled configures the ADC with its minimum throughput
rate of 4 Hz in normal mode. The digital filter frequency response
with this configuration is shown in Figure 26.
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PDF描述
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ADUC7036BCPZ-RL 功能描述:IC SENSOR AUTO 96K FLASH 48LFCSP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:MicroConverter® ADuC7xxx 標(biāo)準(zhǔn)包裝:38 系列:Encore!® XP® 核心處理器:eZ8 芯體尺寸:8-位 速度:5MHz 連通性:IrDA，UART/USART 外圍設(shè)備:欠壓檢測/復(fù)位，LED，POR，PWM，WDT 輸入/輸出數(shù):16 程序存儲(chǔ)器容量:4KB（4K x 8） 程序存儲(chǔ)器類型:閃存 EEPROM 大小:- RAM 容量:1K x 8 電壓 - 電源 (Vcc/Vdd):2.7 V ~ 3.6 V 數(shù)據(jù)轉(zhuǎn)換器:- 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 105°C 封裝/外殼:20-SOIC（0.295"，7.50mm 寬） 包裝:管件 其它名稱:269-4116Z8F0413SH005EG-ND
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