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參數(shù)資料
| 型號： | ADMCF341BR |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | DashDSP⑩ 28-Lead Flash Mixed-Signal DSP with Enhanced Analog Front End |
| 中文描述： | 0-BIT, 10 MHz, OTHER DSP, PDSO28 |
| 封裝： | SOIC-28 |
| 文件頁數(shù)： | 29/36頁 |
| 文件大?。?/td> | 1106K |
| 代理商： | ADMCF341BR |
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REV. 0
ADMCF341
–29–
0
0
0
0
0
0
0
0
0
0
LOW SIDE GATE CHOPPING
0 = DISABLE
1 = ENABLE
HIGH SIDE GATE CHOPPING
DM (0x200B)
GDCLK
GATE DRIVE CHOPPING FREQUENCY
PWMGATE (R/W)
PWMPD (R/W)
DM (0x200A)
PWMPD
PWMCHA (R/W)
PWM CHANNEL A
DUTY CYCLE
DM (0x200C)
PWMCHB (R/W)
PWM CHANNEL B
DUTY CYCLE
DM (0x200D)
PWMCHC (R/W)
DM (0x200E)
PWM CHANNEL C
DUTY CYCLE
T
MIN
= PWMPD
CLKOUT
f
CHOP
=
4 (GDCLK + 1)
f
CLKOUT
0
0
0
0
0
0
0
0
15
14
13
12
11
10
9
8
7
6
5
4
3
2
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0
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9
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1
0
15
14
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9
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3
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1
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14
13
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9
8
7
6
5
4
3
2
1
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9
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5
4
3
2
1
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
Figure 24. Configuration of Additional PWM Registers
Default bit values are shown; if no value is shown, the bit field is undefined at reset.
Reserved bits are shown on a gray field—these bits should always be written as shown.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ADMCF341-EVALKIT | DashDSP⑩ 28-Lead Flash Mixed-Signal DSP with Enhanced Analog Front End |
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| ADN2811ACP-CML | OC-48/OC-48 FEC Clock and Data Recovery IC with Integrated Limiting Amp |
| ADN2811ACP-CML-RL | OC-48/OC-48 FEC Clock and Data Recovery IC with Integrated Limiting Amp |
| ADN2812 | Continuous Rate 12.3 Mb/s to 2.7 Gb/s Clock and Data Recovery IC with Integrated Limiting Amp |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| ADMCF341BRZ-REEL | 制造商:Analog Devices 功能描述: |
| ADMCF341-EVALKIT | 制造商:AD 制造商全稱:Analog Devices 功能描述:DashDSP⑩ 28-Lead Flash Mixed-Signal DSP with Enhanced Analog Front End |
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| AD-MD3FF | 制造商:Pan Pacific 功能描述: |
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