參數資料
型號： ADF4002BRUZ-RL7
廠商： Analog Devices Inc
文件頁數： 18/20頁
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描述： IC PLL FREQUENCY SYNTH 16-TSSOP
設計資源： Very Low Jitter Encode (Sampling) Clocks for High Speed Analog-to-Digital Converters Using ADF4002 (CN0003)
標準包裝： 1,000
類型： 時鐘/頻率合成器（RF），相位檢測器
PLL： 是
輸入： CMOS，TTL
輸出： 時鐘
電路數： 1
比率 - 輸入:輸出： 2:1
差分 - 輸入:輸出： 是/無
頻率 - 最大： 400MHz
除法器/乘法器： 是/無
電源電壓： 2.7 V ~ 3.3 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 16-TSSOP（0.173"，4.40mm 寬）
供應商設備封裝： 16-TSSOP
包裝： 帶卷 (TR)
配用： EVAL-ADF4002EBZ1-ND - BOARD EVAL FOR ADF4002
Data Sheet
ADF4002
Rev. C | Page 7 of 20
TYPICAL PERFORMANCE CHARACTERISTICS
0
–5
–10
–15
–20
–25
–30
–40
–35
0
100
200
300
400
500
600
06052-
027
P
O
W
E
R
(
d
Bm)
FREQUENCY (MHz)
–40°C
+85°C
+25°C
Figure 5. RF Input Sensitivity
0
1
2
3
4
5
10
9
6
8
7
06052-
026
P
O
W
E
R
(
d
Bm)
FREQUENCY (MHz)
0
–5
–10
–15
–20
–25
–40°C
+25°C
+85°C
Figure 6. RF Input Sensitivity, Low Frequency
–70
–80
–90
–100
–110
–120
–130
–140
–150
–160
1k
10k
100k
1M
10M
06052-
031
PH
A
SE
N
O
ISE
(d
B
c
/H
z)
FREQUENCY OFFSET (Hz)
rms NOISE = 0.07 DEGREES
Figure 7. Integrated Phase Noise (400 MHz, 1 MHz, 50 kHz)
–130
–135
–140
–145
–155
–160
–165
–170
–175
–180
100k
1M
10M
100M
1G
06052-
033
PH
A
SE
N
O
ISE
(d
B
c
/H
z)
PFD FREQUENCY (Hz)
Figure 8. Phase Noise (Referred to CP Output) vs. PFD Frequency
06052-
030
REF –4dBm
SAMP LOG 10dB/
ATTN 10dB
VBW 20kHz
MKR1 1.000 MHz
–94.5dBc
CENTER 399.995MHz
RES BW 20kHz
SPAN 2.2MHz
SWEEP 21ms (601pts)
–94.5dBc
0
–10
–20
–30
–40
–50
–60
–70
–90
–100
–80
1
1R
Figure 9. Reference Spurs (400 MHz, 1 MHz, 7 kHz)
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PDF描述
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