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參數(shù)資料
| 型號： | ADAU1442YSVZ-3A |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 70/93頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC SIGMADSP 28B 175MHZ 100TQFP |
| 標準包裝： | 1 |
| 系列： | SigmaDSP® |
| 類型： | 音頻處理器 |
| 應用： | 車載音頻 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-TQFP 裸露焊盤 |
| 供應商設備封裝： | 100-TQFP-EP（14x14） |
| 包裝： | 托盤 |
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Data Sheet
ADAU1442/ADAU1445/ADAU1446
Rev. D | Page 71 of 92
INTERFACING WITH OTHER DEVICES
When interfacing the ADAU1442/ADAU1445/ADAU1446 to other devices in the system, it may be necessary to set the drive strength of
each pin.
DRIVE STRENGTH MODES AND SETTINGS
Bit Clock Pad Strength Register (Address 0xE247)
This register controls the pad drive strength of all bit clock pins configured in master mode. The default 2 mA setting should be adequate
for most applications. The 6 mA setting should be used only when the integrity of the signal is compromised.
Table 71. Bit Descriptions of Bit Clock Pad Strength Register
Bit Position
Description
Default
[15:12]
Reserved
11
BCLK11
0
0 = low strength (2 mA)
1 = high strength (6 mA)
10
BCLK10
0 = low strength (2 mA)
0
1 = high strength (6 mA)
9
BCLK9
0
0 = low strength (2 mA)
1 = high strength (6 mA)
8
BCLK8
0
0 = low strength (2 mA)
1 = high strength (6 mA)
7
BCLK7
0
0 = low strength (2 mA)
1 = high strength (6 mA)
6
BCLK6
0
0 = low strength (2 mA)
1 = high strength (6 mA)
5
BCLK5
0
0 = low strength (2 mA)
1 = high strength (6 mA)
4
BCLK4
0
0 = low strength (2 mA)
1 = high strength (6 mA)
3
BCLK3
0
0 = low strength (2 mA)
1 = high strength (6 mA)
2
BCLK2
0
0 = low strength (2 mA)
1 = high strength (6 mA)
1
BCLK1
0
0 = low strength (2 mA)
1 = high strength (6 mA)
0
BCLK0
0
0 = low strength (2 mA)
1 = high strength (6 mA)
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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