Enable S/PDIF to I2S Outpu" />
參數(shù)資料
型號： ADAU1442YSVZ-3A-RL
廠商： Analog Devices Inc
文件頁數(shù)： 66/93頁
文件大?。?/td> 0K
描述： IC SIGMADSP 28B 175MHZ 100TQFP
標(biāo)準(zhǔn)包裝： 1,000
系列： SigmaDSP®
類型： 音頻處理器
應(yīng)用： 車載音頻
安裝類型： 表面貼裝
封裝/外殼： 100-TQFP 裸露焊盤
供應(yīng)商設(shè)備封裝： 100-TQFP-EP（14x14）
包裝： 帶卷 (TR)
ADAU1442/ADAU1445/ADAU1446
Data Sheet
Rev. D | Page 68 of 92
Enable S/PDIF to I2S Output Register (Address 0xE241)
Table 64. Bit Descriptions of Register 0xE241
Bit Position
Description
Default
[15:3]
Reserved
2
Output mode
0
0 = I2S
1 = TDM
1
Group 2 enable
0
0 = Group 2 off
1 = Group 2 on
0
Group 1 enable
0
0 = Group 1 off
1 = Group 1 on
The S/PDIF receiver can be set to send the stereo audio stream
and the auxiliary S/PDIF bits in I2S or TDM format on eight of
the 12 MP pins. The eight outputs are divided into two groups:
Group 1 converts S/PDIF to I2S (LRCLK, BCLK, and SDATA
signals), and Group 2 decodes the channel status and user data
bits (virtual LRCLK, user data, channel status, validity bit, and
block start signal).
This MP output is controlled by setting three bits in
Register 0xE241:
Bit 0 switches Group 1 on and off.
Bit 1 switches Group 2 on and off.
Bit 2 switches between I2S and TDM modes.
When S/PDIF to I2S mode is active, the pins described in Table 53
are used.
When TDM mode is active, Slot 0 and Slot 4 contain the audio
data, and Slot 1 contains the streamed block start, channel status,
user data, and validity bits (see Table 65). The bits are streamed
in real time and are synchronized to the audio data. Only the
seven MSBs of Slot 1 are used, as shown in Table 65. The corre-
sponding TDM format is shown in more detail in Figure 54.
Table 65. Function of Decoded Bits in Figure 54
Bit Position
Description
31
Block start (high for first 16 samples)
30
Channel status of right channel
29
Channel status of left channel
28
User data bit, right channel
27
User data bit, left channel
26
Validity bit, right channel
25
Validity bit, left channel
[24:0]
Not used
FRAME
LRCLKx
0
1
2
3
4
5
6
7
LEFT AUDIO
RIGHT AUDIO
DECODE BITS
0
1
24 BITS: LEFT AUDIO
7 DECODED
BITS
4
24 BITS: RIGHT AUDIO
07696-
055
Figure 54. S/PDIF TDM Signal
相關(guān)PDF資料
PDF描述
ADAU1445YSVZ-3A-RL IC SIGMADSP 175MHZ 100TQFP
ADAU1461WBCPZ-R7 IC SIGMADSP 24BIT 96KHZ PLL 32
ADAU1513ACPZ-RL7 IC AMP AUDIO PWR 23W 48LFCSP
ADAU1590ACPZ-RL7 IC AMP AUDIO PWR 48LFCSP
ADAU1592ACPZ IC AMP AUDIO PWR 24W 48LFCSP
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參數(shù)描述
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