參數(shù)資料
型號(hào)： AD9991KCPZ
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 42/60頁(yè)
文件大?。?/td> 0K
描述： IC CCD SIGNAL PROCESSOR 56-LFCSP
標(biāo)準(zhǔn)包裝： 1
類型： CCD 信號(hào)處理器，10 位
輸入類型： 邏輯
輸出類型： 邏輯
接口： 3 線串口
安裝類型： 表面貼裝
封裝/外殼： 56-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 56-LFCSP-VQ（8x8）
包裝： 帶卷 (TR)
AD9991
–47–
Table XXXII. V-Pattern Group 6 (VPAT6) Register Map (continued)
Data Bit Default
Address Content
Value
Register Name
Description
50
[11:0]
0
V5TOG3_6
V5 Toggle Position 3
[23:12]
0
V6TOG1_6
V6 Toggle Position 1
51
[11:0]
0
V6TOG2_6
V6 Toggle Position 2
[23:12]
0
V6TOG3_6
V6 Toggle Position 3
52
[11:0]
0
FREEZE1_6
V1–V6 Freeze Position 1
[23:12]
0
RESUME1_6
V1–V6 Resume Position 1
53
[11:0]
0
FREEZE2_6
V1–V6 Freeze Position 2
[23:12]
0
RESUME2_6
V1–V6 Resume Position 2
Table XXXIII. V-Pattern Group 7 (VPAT7) Register Map
Data Bit Default
Address Content
Value
Register Name
Description
54
[5:0]
0
VPOL_7
VPAT7 Start Polarity. V1[0]. V2[1]. V3[2]. V4[3]. V5[4]. V6[5].
[11:6]
0
UNUSED
Unused.
[23:12]
0
VPATLEN_7
Total Length of VPAT7. Note: If using VPAT7 as a second V-sequence in
the VSG active line, this value is the start position for second V-sequence.
55
[11:0]
0
V1TOG1_7
V1 Toggle Position 1
[23:12]
0
V1TOG2_7
V1 Toggle Position 2
56
[11:0]
0
V1TOG3_7
V1 Toggle Position 3
[23:12]
0
V2TOG1_7
V2 Toggle Position 1
57
[11:0]
0
V2TOG2_7
V2 Toggle Position 2
[23:12]
0
V2TOG3_7
V2 Toggle Position 3
58
[11:0]
0
V3TOG1_7
V3 Toggle Position 1
[23:12]
0
V3TOG2_7
V3 Toggle Position 2
59
[11:0]
0
V3TOG3_7
V3Toggle Position 3
[23:12]
0
V4TOG1_7
V4 Toggle Position 1
5A
[11:0]
0
V4TOG2_7
V4 Toggle Position 2
[23:12]
0
V4TOG3_7
V4 Toggle Position 3
5B
[11:0]
0
V5TOG1_7
V5 Toggle Position 1
[23:12]
0
V5TOG2_7
V5 Toggle Position 2
5C
[11:0]
0
V5TOG3_7
V5 Toggle Position 3
[23:12]
0
V6TOG1_7
V6 Toggle Position 1
5D
[11:0]
0
V6TOG2_7
V6 Toggle Position 2
[23:12]
0
V6TOG3_7
V6 Toggle Position 3
5E
[11:0]
0
FREEZE1_7
V1–V6 Freeze Position 1
[23:12]
0
RESUME1_7
V1–V6 Resume Position 1
5F
[11:0]
0
FREEZE2_7
V1–V6 Freeze Position 2
[23:12]
0
RESUME2_7
V1–V6 Resume Position 2
Table XXXIV. V-Pattern Group 8 (VPAT8) Register Map
Data Bit Default
Address Content
Value
Register Name
Description
60
[5:0]
0
VPOL_8
VPAT8 Start Polarity. V1[0]. V2[1]. V3[2]. V4[3]. V5[4]. V6[5].
[11:6]
0
UNUSED
Unused.
[23:12]
0
VPATLEN_8
Total Length of VPAT8. Note: If using VPAT8 as a second V-sequence in
the VSG active line, this value is the start position for second V-sequence.
61
[11:0]
0
V1TOG1_8
V1 Toggle Position 1
[23:12]
0
V1TOG2_8
V1 Toggle Position 2
62
[11:0]
0
V1TOG3_8
V1 Toggle Position 3
[23:12]
0
V1TOG4_8
V1 Toggle Position 4
REV. 0
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PDF描述
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參數(shù)描述
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AD9992 制造商:AD 制造商全稱:Analog Devices 功能描述:12-Bit CCD Signal Processor with Precision Timing Generator
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