參數(shù)資料
型號: AD9522-4/PCBZ
廠商: Analog Devices Inc
文件頁數(shù): 42/84頁
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描述: BOARD EVAL FOR AD9522-4 CLK GEN
設計資源: AD9522 Eval Board Schematic
AD9522 BOM
標準包裝: 1
主要目的: 計時,時鐘發(fā)生器
嵌入式:
已用 IC / 零件: AD9522-4
主要屬性: 12 LVDS/24 CMOS 輸出,1.6 GHz VCO
次要屬性: I²C & SPI 接口
已供物品:
AD9522-4
Rev. 0 | Page 47 of 84
12
3
4
5
6
7
8
910
INPUT TO VCO DIVIDER
INPUT TO CHANNEL DIVIDER
OUTPUT OF
CHANNEL DIVIDER
SYNC PIN
1
11
12
13
14
14 TO 15 CYCLES AT CHANNEL DIVIDER INPUT + 1 CYCLE AT VCO DIVIDER INPUT
CHANNEL DIVIDER OUTPUT STATIC
CHANNEL DIVIDER
OUTPUT CLOCKING
CHANNEL DIVIDER
OUTPUT CLOCKING
07
22
5-
0
73
Figure 52. SYNC Timing Pipeline Delay When the VCO Divider Is Used—CLK or VCO Is Input
INPUT TO CLK
INPUT TO CHANNEL DIVIDER
OUTPUT OF
CHANNEL DIVIDER
SYNC PIN
14 TO 15 CYCLES AT CHANNEL DIVIDER INPUT + 1 CYCLE AT CLK INPUT
12
3
4
5
6
7
8
910
11
12
13
14
1
CHANNEL DIVIDER OUTPUT STATIC
CHANNEL DIVIDER
OUTPUT CLOCKING
CHANNEL DIVIDER
OUTPUT CLOCKING
0
72
25
-07
4
Figure 53. SYNC Timing Pipeline Delay When the VCO Divider Is Not Used—CLK Input Only
LVDS Output Drivers
The AD9522 output drivers can be configured as either an
LVDS differential output or as a pair of CMOS single-ended
outputs. The LVDS outputs allow for selectable output current
from ~1.75 mA to ~7 mA.
The LVDS output polarity can be set as noninverting or
inverting, which allows for the adjustment of the relative
polarity of outputs within an application without requiring a
board layout change. Each LVDS output can be individually
powered down to save power.
OUT
3.5mA
07
22
5-
1
34
Figure 54. LVDS Output Simplified Equivalent Circuit with
3.5 mA Typical Current Source
相關PDF資料
PDF描述
AD9520-0/PCBZ BOARD EVAL AD9520-0
SRR4018-270Y INDUCTOR POWER 27UH 0.77A 4018
MLF2012E8R2K INDUCTOR MULTILAYER 8.2UH 0805
V110B48E150BL CONVERTER MOD DC/DC 48V 150W
AD9515/PCBZ BOARD EVAL CLOCK 2CH AD9515
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參數(shù)描述
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