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參數(shù)資料
| 型號： | AD9510-VCO/PCBZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 42/56頁 |
| 文件大?。?/td> | 0K |
| 描述： | BOARD EVALUATION FOR AD9510 |
| 設(shè)計資源： | AD9510 Eval Brd BOM AD9510 Eval Brd Schematics AD9510 Gerber Files |
| 標準包裝： | 1 |
| 主要目的： | 計時，時鐘分配 |
| 已用 IC / 零件： | AD9510 |
| 已供物品： | 板 |
| 相關(guān)產(chǎn)品： | AD9510BCPZ-ND - IC CLOCK DIST 8OUT PLL 64LFCSP AD9510BCPZ-REEL7-ND - IC CLOCK DIST 8OUT PLL 64LFCSP |
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Data Sheet
AD9510
Rev. B | Page 47 of 56
Reg.
Addr.
(Hex) Bit(s) Name
Description
08
[5:2] PLL mux control
[5]
[4]
[3]
[2]
MUXOUT—Signal on STATUS Pin
0
Off (signal goes low) (default)
0
1
Digital lock detect (active high)
0
1
0
N divider output
0
1
Digital lock detect (active low)
0
1
0
R divider output
0
1
0
1
Analog lock detect (N channel, open-drain)
0
1
0
A counter output
0
1
Prescaler output (NCLK)
1
0
PFD up pulse
1
0
1
PFD down pulse
1
0
1
0
Loss of reference (active high)
1
0
1
Tristate
1
0
Analog lock detect (P channel, open-drain)
1
0
1
Loss of reference or loss of lock (inverse of DLD) (active high)
1
0
Loss of reference or loss of lock (inverse of DLD) (active low)
1
Loss of reference (active low)
MUXOUT is the PLL portion of the STATUS output MUX.
08
[6]
Phase frequency
detector (PFD)
polarity
0 = negative (default), 1 = positive.
08
[7]
Not used.
09
[0]
Reset all counters
0 = normal (default), 1 = reset R, A, and B counters.
09
[1]
N-counter reset
0 = normal (default), 1 = reset A and B counters.
09
[2]
R-counter reset
0 = normal (default), 1 = reset R counter.
09
[3]
Not used.
09
[6:4] Charge pump (CP)
current setting
[6]
[5]
[4]
ICP (mA)
0
0.60
0
1
1.2
0
1
0
1.8
0
1
2.4
1
0
3.0
1
0
1
3.6
1
0
4.2
1
4.8
Default = 000b.
These currents assume: CPRSET = 5.1 kΩ.
Actual current can be calculated by: CP_LSB = 3.06/CPRSET.
09
[7]
Not used.
0A
[1:0] PLL power-down
01 = Asynchronous power-down (default).
[1]
[0]
Mode
0
Normal operation
0
1
Asynchronous power-down
1
0
Normal operation
1
Synchronous power-down
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