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參數(shù)資料
| 型號： | AD73322LARUZ-REEL |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 15/43頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC PROCESSOR FRONTEND DL 28TSSOP |
| 標(biāo)準(zhǔn)包裝： | 2,500 |
| 位數(shù)： | 16 |
| 通道數(shù)： | 4 |
| 功率（瓦特）： | 73mW |
| 電壓 - 電源，模擬： | 2.7 V ~ 5.5 V |
| 電壓 - 電源，數(shù)字： | 2.7 V ~ 5.5 V |
| 封裝/外殼： | 28-TSSOP（0.173"，4.40mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 28-TSSOP |
| 包裝： | 帶卷 (TR) |
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AD73322
–22–
REV. B
Table XVII. Control Register D Description
CONTROL REGISTER D
76
543
210
MUTE
OGS2
OGS1
OGS0
RMOD
IGS2
IGS1
IGS0
Bit
Name
Description
0
IGS0
Input Gain Select (Bit 0)
1
IGS1
Input Gain Select (Bit 1)
2
IGS2
Input Gain Select (Bit 2)
3
RMOD
Reset ADC Modulator (0 = Off; 1 = Reset Enabled)
4
OGS0
Output Gain Select (Bit 0)
5
OGS1
Output Gain Select (Bit 1)
6
OGS2
Output Gain Select (Bit 2)
7
MUTE
Output Mute (0 = Mute Off; 1 = Mute Enabled)
Table XVIII. Control Register E Description
CONTROL REGISTER E
76
543
21
0
—
DGTE
IBYP
DA4
DA3
DA2
DA1
DA0
Bit
Name
Description
0
DA0
DAC Advance Setting (Bit 0)
1
DA1
DAC Advance Setting (Bit 1)
2
DA2
DAC Advance Setting (Bit 2)
3
DA3
DAC Advance Setting (Bit 3)
4
DA4
DAC Advance Setting (Bit 4)
5
IBYP
Interpolator Bypass (0 = Bypass Disabled; 1 = Bypass Enabled)
6
DGTE
Digital Gain Tap Enable (0 = Disabled; 1 = Enabled)
7
—
Reserved (Program to 0)
Table XIX. Control Register F Description
CONTROL REGISTER F
76
543
21
0
ALB/
AGTM
INV
SEEN/
AGTE
AGTC4
AGTC3
AGTC2
AGTC1
AGTC0
Bit
Name
Description
0
AGTC0
Analog Gain Tap Coefficient (Bit 0)
1
AGTC1
Analog Gain Tap Coefficient (Bit 1)
2
AGTC2
Analog Gain Tap Coefficient (Bit 2)
3
AGTC3
Analog Gain Tap Coefficient (Bit 3)
4
AGTC4
Analog Gain Tap Coefficient (Bit 4)
5
SEEN/
Single-Ended Enable (0 = Disabled; 1 = Enabled)
AGTE
Analog Gain Tap Enable (0 = Disabled; 1 = Enabled)
6
INV
Input Invert (0 = Disabled; 1 = Enabled)
7
ALB/
Analog Loopback of Output to Input (0 = Disabled; 1 = Enabled)
AGTM
Analog Gain Tap Mute (0 = Off; 1 = Muted)
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