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參數(shù)資料
| 型號： | 9S12XDP512DGV2 |
| 英文描述： | Device User Guide for Mask Set L15Y - (Second Silicon - Enhanced Feature Set) |
| 中文描述： | 設(shè)備用戶指南掩模組L15Y - （二硅-增強(qiáng)的功能集） |
| 文件頁數(shù)： | 73/152頁 |
| 文件大?。?/td> | 1231K |
| 代理商： | 9S12XDP512DGV2 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁當(dāng)前第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁
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2.3.5 XFC — PLL Loop Filter Pin
Please ask your Motorola representative for the interactive application note to compute PLL loop filter
elements. Any current leakage on this pin must be avoided.
Figure 2-4 PLL Loop Filter Connections
2.3.6 BKGD / MODC — Background Debug and Mode Pin
The BKGD/MODC pin is used as a pseudo-open-drain pin for the background debug communication. It
is used as a MCU operating mode select pin during reset. The state of this pin is latched to the MODC bit
at the rising edge of RESET. The BKGD pin has a pullup device.
2.3.7 PAD[23:08] / AN[15:0] — Port AD Input Pin of ATD1
PAD[23:08] are general purpose input or output pins and analog inputs AN[15:0] of the analog to digital
converter ATD1.
2.3.8 PAD[07:00] / AN[7:0] — Port AD Input Pins of ATD0
PAD[07:00] are general purpose input or output pins and analog inputs AN[7:0] of the analog to digital
converter ATD0.
2.3.9 PA[7:0] / ADDR[15:8] / IVD[15:8] — Port A I/O Pins
PA7-PA0 are general purpose input or output pins. In MCU expanded modes of operation, these pins are
used for the external address bus. In MCU emulation modes of operation, these pins are used for external
address bus and internal visibility read data.
2.3.10 PB[7:1] / ADDR[7:1] / IVD[7:1] — Port B I/O Pins
PB7-PB1 are general purpose input or output pins. In MCU expanded modes of operation, these pins are
used for the external address bus. In MCU emulation modes of operation, these pins are used for external
address bus and internal visibility read data.
MCU
XFC
R
0
C
S
C
P
VDDPLL
VDDPLL
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
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