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參數資料
| 型號： | XRT94L33IB |
| 廠商： | Exar Corporation |
| 文件頁數： | 75/465頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MAPPER DS3/E3/STS-1 504TBGA |
| 標準包裝： | 24 |
| 應用： | 網絡切換 |
| 接口： | 總線 |
| 電源電壓： | 3.14 V ~ 3.47 V |
| 封裝/外殼： | 504-LBGA |
| 供應商設備封裝： | 504-TBGA（35x35） |
| 包裝： | 托盤 |
| 安裝類型： | 表面貼裝 |
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XRT94L33
xr
Rev.1.2.0.
3-CHANNEL DS3/E3/STS-1 TO STS-3/STM-1 MAPPER IC DATA SHEET
166
2.2.1.3.8
ATM Layer Processor “polling” of the UNIs, in the Multi-PHY Mode
In this section, the various Multi-PHY Operations (e.g., polling and selection for writing) will be first discussed
for a “Conceptual Multi-PHY” System, and then later, specifically for the XRT94L33. When the XRT94L33 is
operating in the “Multi-PHY” mode, then the Transmit UTOPIA Interface block will automatically be configured
to support “polling”. “Polling” allows an ATM Layer processor (which is interfaced to several UNI devices) to
determine which UNIs are capable of receiving and handling additional ATM cell data, at any given time. The
manner in which the ATM Layer processor “polls” its UNI devices, (per the “Conceptual Multi-PHY” system)
follows.
Figure 15 An Illustration of the “Conceptual Multi-PHY System consisting of UNI Devices #1 and #2
TxUData[15:0]
TxUAddr[4:0]
TxUPrty
TxUEnb*
TxUSoC
TxUClav
RxUData[15:0]
RxUAddr[4:0]
RxUPrty
RxUEnb*
RxUSoC
RxUClav
UNI # 1
TxAddr = 0x00
RxAddr = 0x01
TxUData[15:0]
TxUAddr[4:0]
TxUPrty
TxUEnb*
TxUSoC
TxUClav
RxUData[15:0]
RxUAddr[4:0]
RxUPrty
RxUEnb*
RxUSoC
RxUClav
TxAddr = 0x02 RxAddr = 0x03
TxData[15:0]
Ut_Addr[4:0]
Tx_Parity
Tx_Ut_WR*
Tx_SoC_out
TxClav_In
RxData[15:0]
Rx_Parity
Rx_Ut_Rd*
Rx_SoC_In
RxClav_In
ATM Layer Processor
UNI # 2
2.2.1.3.9
ATM Layer Processor “polling” in a Conceptual Multi-PHY System
Figure 26 depicts a “Multi-PHY” system consisting of a single ATM Layer processor and two (2) UNI devices,
which are designated as “UNI #1” and “UNI #2”. In this figure, both of the UNIs are connected to the ATM
Layer processor via a common “Transmit UTOPIA” Data Bus, a common “Receive UTOPIA” Data Bus, a
common “TxUClav” line, a common “RxUClav” line, as well as common TxUEnB*, RxUEnB*, TxUSoC and
RxUSoC lines. The ATM Layer processor will also be addressing both the Transmit and Receive UTOPIA
Interface blocks via a common “UTOPIA” address bus (Ut_Addr[4:0]) Therefore, the Transmit and Receive
UTOPIA Interface Blocks, within a given UNI might have different addresses; as depicted in Figure 26.
The UTOPIA Address values, that have been assigned to each of the Transmit and Receive UTOPIA
Interface blocks, within Figure 15, are listed below in Table 13.
相關PDF資料 |
PDF描述 |
|---|---|
| VI-B4J-IW-F1 | CONVERTER MOD DC/DC 36V 100W |
| 5413558-1 | CONN JACK BNC RT ANG 75 OHM GOLD |
| D38999/20WF32SN | CONN RCPT 32POS WALL MNT W/SCKT |
| D38999/20FF32SN | CONN RCPT 32POS WALL MNT W/SCKT |
| 5413515-2 | CONN JACK BNC RT ANG 50 OHM 30AU |
相關代理商/技術參數 |
參數描述 |
|---|---|
| XRT94L33IB-F | 功能描述:網絡控制器與處理器 IC Demapper RoHS:否 制造商:Micrel 產品:Controller Area Network (CAN) 收發(fā)器數量: 數據速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT94L33IB-L | 功能描述:網絡控制器與處理器 IC Mapper / Demapper RoHS:否 制造商:Micrel 產品:Controller Area Network (CAN) 收發(fā)器數量: 數據速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT94L43 | 制造商:EXAR 制造商全稱:EXAR 功能描述:SONET/SDH STS-12/STM-4 TO E3/DS3/STS-1 MAPPER/DEMAPPER |
| XRT94L43_06 | 制造商:EXAR 制造商全稱:EXAR 功能描述:SONET/SDH OC-12 TO 12XDS3/E3 MAPPER |
| XRT94L43A | 制造商:EXAR 制造商全稱:EXAR 功能描述:SONET/SDH OC-12 TO 12XDS3/E3 MAPPER |
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