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參數(shù)資料
| 型號： | XRT81L27IV-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 17/30頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC LIU EI 7CH 3.3V 128TQFP |
| 標(biāo)準(zhǔn)包裝： | 72 |
| 應(yīng)用： | DECT |
| 接口： | 串行 |
| 電源電壓： | 3.3V |
| 封裝/外殼： | 128-LQFP |
| 供應(yīng)商設(shè)備封裝： | 128-TQFP（14x20） |
| 包裝： | 托盤 |
| 安裝類型： | 表面貼裝 |
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XRT81L27
á
SEVEN CHANNEL E1 LINE INTERFACE UNIT WITH CLOCK RECOVERY
REV. 1.1.0
22
2.5
THE LINE DRIVER BLOCK
The driver block will take the TP and TN pulses out of
the Pulse Shaping circuit and apply these to the TTIP
and TRING pins. Output drive control is available
from either a dedicated signal or (in Host mode) from
one of register control bits to turn the channel “off” by
placing the drivers in a high impedance state.
2.6
INTERFACING THE TRANSMIT SECTIONS OF THE
XRT81L27 TO THE LINE
In both (75
or 120) applications, the user is ad-
vised to interface the Transmitter to the Line, using
the termination as shown in Figure 12. This includes
1:2 transformer with the intrinsic impedance of the
line used as a termination resistance.
The configuration differs only in the type of line con-
nects, The internal circuit adjusts to the load imped-
ance
FIGURE 11. ITU-T G.703 PULSE TEMPLATE
10
%
10
%
10
%
10
%
10
%
10
%
269 ns
(244 + 25)
194 ns
(244 – 50)
244 ns
219 ns
(244 – 25)
488 ns
(244 + 244)
0%
50%
20
%
V= 100%
No m ina l pulse
Note – V corresponds to the nominal peak value.
20
%
20
%
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT82D20IW-F | IC LIU E1 SGL 28SOJ |
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| XRT83D10IW | IC LIU T1/E1 SGL 28SOJ |
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| XRT83L314IB-L | IC LIU T1/E1/J1 14CH 304TBGA |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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