參數(shù)資料
型號(hào)： XPC8240LVV200E
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 6/52頁(yè)
文件大?。?/td> 0K
描述： IC MPU INTEGRATED 200MHZ 352TBGA
標(biāo)準(zhǔn)包裝： 24
系列： MPC82xx
處理器類型： 32-位 MPC82xx PowerQUICC II
速度： 200MHz
電壓： 2.5V
安裝類型： 表面貼裝
封裝/外殼： 352-LBGA
供應(yīng)商設(shè)備封裝： 352-TBGA（35x35）
包裝： 托盤
14
MPC8240 Integrated Processor Hardware Specifications
Electrical and Thermal Characteristics
Figure 7. DLL Locking Range Loop Delay vs. Frequency of Operation
1.4.2.3
Input AC Timing Specifications
Table 8 provides the input AC timing specifications. See Figure 8 and Figure 9 for the input-output timing
diagrams referenced to SDRAM_SYNC_IN and PCI_SYNC_IN, respectively.
Table 8. Input AC Timing Specifications
At recommended operating conditions (see Table 2) with LVDD = 3.3 V ± 0.3 V
Num
Characteristic
Min
Max
Unit
Notes
10a
PCI input signals valid to PCI_SYNC_IN (input setup)
2.0
—
ns
2, 3
10b1 Memory control and data input signals in flow through mode valid to
SDRAM_SYNC_IN (input setup)
3.0
—
ns
1, 3
10b2 Memory control and data input signals in registered/in-line mode valid
to SDRAM_SYNC_IN (input setup)
2.5
—
ns
1, 3
10b3 Memory control and data signals accessing non-DRAM valid to
SDRAM_SYNC_IN (input setup)
3.0
—
ns
1, 3
10c
PIC, miscellaneous debug input signals valid to SDRAM_SYNC_IN
(input setup)
3.0
—
ns
1, 3
10d
I2C input signals valid to SDRAM_SYNC_IN (input setup)
2.0
—
ns
1, 3
10e
Mode select inputs valid to HRST_CPU/HRST_CTRL (input setup)
9
× tCLK
—ns
1, 3–5
DLL not guaranteed to lock
N = 1
DLL_STANDARD = 0
N = 1
DLL_STANDARD = 1
N = 2
DLL_STANDARD = 0
DLL will lock
0
Tloop Propagation Delay Time (ns)
T
cl
kSD
R
A
M
_
SYN
C
_
OU
T
Peri
od
a
nd
Freq
uen
cy
10
515
100 MHz
10 ns
50 MHz
20 ns
33 MHz
30 ns
25 MHz
40 ns
N = 2
DLL_STANDARD = 1
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述
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