參數(shù)資料
型號(hào)： XCCACE128-I
廠商： Xilinx Inc
文件頁(yè)數(shù)： 55/69頁(yè)
文件大?。?/td> 0K
描述： IC 128MBIT ACE FLASH CARD
標(biāo)準(zhǔn)包裝： 1
存儲(chǔ)容量： 128Mb
存儲(chǔ)器類(lèi)型： FLASH
System ACE CompactFlash Solution
DS080 (v3.0) April 7, 2014
59
Product Specification
R
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
Test JTAG Interface Timing Characteristics
Miscellaneous Timing Characteristics
Table 32: Test JTAG Interface Timing Characteristics
Symbol
Parameter
Min
Max
Units
TS(TSTTDITSTTCK)
TSTTDI setup time before rising edge of TSTTCK
4
ns
TS(TSTTMSTSTTCK)
TSTTMS setup time before rising edge of TSTTCK
4
ns
TS(INTSTTCK)
All other inputs setup time before rising edge of TSTTCK
5
ns
TH(TSTTCKTSTTDI)
TSTTDI hold time after rising edge of TSTTCK
4
ns
TH(TSTTCKTSTTMS)
TSTTMS hold time after rising edge of TSTTCK
4
ns
TH(TSTTCKIN)
All other inputs hold time after rising edge of TSTTCK
4
ns
TD(TSTTCKOUT)
TSTTCK falling edge to all other outputs
24
ns
TD(TSTTCKCFGTCK)
Propagation delay from TSTTCK to CFGTCK
14
ns
TD(CFGTDITSTTDO)
Propagation delay from CFGTDI to TSTTDO
11
ns
TD(TSTTMSCFGTMS)
Propagation delay from TSTTMS to CFGTMS
13
ns
Table 33: Miscellaneous Timing Characteristics
Symbol
Parameter
Min
Max
Units
TS(RESETCLK)
RESET setup time before rising edge of CLK
7
ns
TH(CLKRESET)
RESET hold time after rising edge of CLK
4
ns
TH(CLKERRLED)
CLK rising edge to ERRLED
17
ns
TH(CLKSTATLED)
CLK rising edge to STATLED
17
ns
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PDF描述
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