參數資料
| 型號： | XC6SLX75T-2FG676I |
| 廠商： | Xilinx Inc |
| 文件頁數： | 80/89頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA SPARTAN 6 676FGGBGA |
| 標準包裝： | 40 |
| 系列： | Spartan® 6 LXT |
| LAB/CLB數： | 5831 |
| 邏輯元件/單元數： | 74637 |
| RAM 位總計： | 3170304 |
| 輸入/輸出數： | 348 |
| 電源電壓： | 1.14 V ~ 1.26 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 100°C |
| 封裝/外殼： | 676-BGA |
| 供應商設備封裝： | 676-FBGA（27x27） |
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Spartan-6 FPGA Data Sheet: DC and Switching Characteristics
DS162 (v3.0) October 17, 2011
Product Specification
81
TBUFIOSKEW
I/O clock tree skew across one clock region
LX4
0.06
N/A
0.06
0.07
ns
LX9
0.060.060.060.07
ns
LX16
0.06
0.07
ns
LX25
0.06
0.07
ns
LX25T
0.06
N/A
ns
LX45
0.06
0.07
ns
LX45T
0.06
N/A
ns
LX75
0.06
0.07
ns
LX75T
0.06
N/A
ns
LX100
0.06
0.07
ns
LX100T
0.06
N/A
ns
LX150
0.06
0.07
ns
LX150T
0.06
N/A
ns
Notes:
1.
LXT devices are not available with a -1L speed grade. The LX4 is not available in -3N speed grade.
2.
These parameters represent the worst-case duty cycle distortion observable at the pins of the device using LVDS output buffers. For cases where
other I/O standards are used, IBIS can be used to calculate any additional duty cycle distortion that might be caused by asymmetrical rise/fall times.
3.
The TCKSKEW value represents the worst-case clock-tree skew observable between sequential I/O elements. Significantly less clock-tree skew exists
for I/O registers that are close to each other and fed by the same or adjacent clock-tree branches. Use the Xilinx FPGA Editor and Timing Analyzer
tools to evaluate clock skew specific to your application.
4.
The TCKSKEW is 0.43 ns for the XA6SLX100 device using a -2 speed grade and 0.22 ns for the XC6SLX100 devices using the -2 speed grade.
Table 79: Package Skew
Symbol
Description
Device
Package(2)
Value
Units
TPKGSKEW
Package Skew(1)
LX4
TQG144
N/A
ps
CPG196
23
ps
CSG225
58
ps
LX9
TQG144
N/A
ps
CPG196
23
ps
CSG225
58
ps
FT(G)256
88
ps
CSG324
64
ps
LX16
CPG196
19
ps
CSG225
70
ps
FT(G)256
71
ps
CSG324
54
ps
LX25
FT(G)256
90
ps
CSG324
61
ps
FG(G)484
84
ps
LX25T
CSG324
48
ps
FG(G)484
112
ps
Table 78: Duty Cycle Distortion and Clock-Tree Skew (Cont’d)
Symbol
Description
Device(1)
Speed Grade
Units
-3
-3N
-2
-1L
相關PDF資料 |
PDF描述 |
|---|---|
| XC6SLX75T-2FGG676I | IC FPGA SPARTAN 6 74K 676FGGBGA |
| ACB100DHHN | CONN EDGECARD 200PS .050 DIP SLD |
| ABB100DHHN | CONN EDGECARD 200PS .050 DIP SLD |
| ACB100DHHD | CONN EDGECARD 200PS .050 DIP SLD |
| ABB100DHHD | CONN EDGECARD 200PS .050 DIP SLD |
相關代理商/技術參數 |
參數描述 |
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